Universidad Tecnolgica La Salle

ULSA

Componente: Electrnica Digital I Ao: II Integrantes: Victor A Contreras H Mario Jos Paiz Ruiz Grupo: I

Procedimiento I
El circuito integrado 74283 implementa un sumador binario completo de 2 nmeros de 4

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bits.

1. Realice el montaje del circuito que se muestra a continuacin

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2. Realice un mnimo de 6 sumas para comprobar su funcionamiento. A3 0 0 0 0 1 1 A2 0 0 1 0 1 1 A1 1 1 O 1 0 1 A0 1 1 0 0 0 1 B3 0 0 1 0 0 1 B2 0 0 0 1 0 1 B1 0 1 1 0 0 1 B0 1 1 0 0 1 1 C4 0 0 0 0 0 1 S3 0 0 1 0 1 1 S2 1 1 1 1 1 1 S1 0 1 1 1 0 1 S0 0 0 0 0 1 0

3. Modifique el circuito de tal manera que utilice el acarreo de entrada.

C0 0 1 1 0 0 1

A3 0 0 0 0 1 1

A2 0 0 1 0 1 1

A1 1 1 0 1 0 1

A0 1 1 0 0 0 1

B3 0 0 1 0 0 1

B2 0 0 0 1 0 1

B1 0 1 1 0 0 1

B0 1 1 0 0 1 1

C4 0 0 0 0 0 1

S3 0 0 1 0 1 1

S2 1 1 1 1 1 1

S1 0 1 0 1 0 1

S0 0 1 0 0 1 1

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Procedimiento II
4. Modifique el circuito anterior e incluya el 7447 y el display de 7 segmentos a como se muestra a continuacin

Mencione qu inconveniente existe en el circuito anterior. Se muestran todos los dgitos correspondientes a la suma de los nmeros de 4 bits? El principal inconveniente es que cuando la suman los dos nmeros de cuatro bits era mayor que nueve, el display no puede mostrar el resultado.

Procedimiento III
Consulte el libro de Tocci, 8 edicin, en la pgina 299, realice y simule el esquema correspondiente de tal manera que la suma de dos nmeros de 4 bits cada uno se muestre en dos displays.

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Conclusiones
1. Cules son las partes bsicas de un sumador completo con representacin en BCD7segmentos? Dibuje un diagrama de bloques y explique el funcionamiento.

Funciona de la siguiente manera, iniciamos el circuito introducimos dos nmeros binarios por ejemplo 7 y 8 7 +8 15 0111 +1001 1111 BCD para 7 BCD para 8 grupo de cdigo no valido para BCD

Como el resultado es 15 y es mayor que 9 porque la suma 1111 no existe en BCD, es uno de los seis grupos de cdigo de 4 bits prohibidos o no vlidos. Y siempre que esto ocurra la suma tiene que ser corregida aadindole un seis (0110) para tomar en cuenta la omisin de los seis grupos de cdigos no vlidos y que quedara as: 0111 +1001 1111 +0110 0001 0101 BCD para 7 BCD para 8 suma no valida sumar 6 para corregir no valida BCD para 15

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2. Explique en qu consiste el circuito del procedimiento III y de la correccin del sumador en BCD. Consiste en poner en prctica la teora de sumatoria en BCD en un circuito lgico en el cual nos represente por medio de dos display el resultado de la suma binaria en decimal, utilizando dos entradas binarias, circuitos integrados 74283, 7447 (Decodificador BDC a 7 segmentos), 7408 y 7432 . 3. Qu tipo de configuracin tienen los display de 7 segmentos? nodo Comn? Ctodo Comn? Explique el funcionamiento de los leds en los displays. Existen dos tipos de display de 7 segmentos: 1) nodo Comn: es aquel donde los nodos de todos los leds se conectan internamente al punto de unin U y los ctodos se encuentran disponibles desde afuera del integrado.

2) Ctodo Comn: es aquel donde los ctodos de todos los leds se conectan internamente al punto de unin U y los nodos se encuentran disponibles desde afuera del integrado.

Los display de siete segmentos no son ni ms ni menos que un conjunto de 7 leds conectados y posicionados apropiadamente. Encendiendo algunos de ellos y apagando otros podemos ir formando diferentes nmeros.

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4. Qu segmentos encienden con las siguientes combinaciones a la entrada 1010, 1100, 1111 y 1110? El primer nmero es 10, el segundo es 12 e, el tercero es 15 y el cuarto es 14, y todos son mayores que 9 as que con un solo display no se puede mostrar por lo que se necesita que se corrija sumndole 6 o 0110 a cada cifra para poder demostrarlo con dos display. 5. Cmo funciona el 7447? Cmo funciona el 74283? El decodificador integrado 7447 es un circuito lgico que convierte el cdigo binario de entrada en formato BCD a niveles lgicos que permiten activar un display de 7 segmentos en donde la posicin de cada barra forma el nmero decodificado. El sumador integrado 74283 es un circuito lgico que suma dos nmeros de cuatro bits A0,A1,A2,A3 y B0,B1,B2,B3 con un acarreo de entrada C0 y devuelve un resultado S0,S1,S2,S3, con un acarreo de salida C4.

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