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INSTITUTO POLITCNICO NACIONAL

ESCUELA SUPERIOR DE CMPUTO


LABORATORIO DE ELECTRNICA DIGITAL

PRCTICA No. 7
CONTADOR ASNCRONO ASCENDENTEDESCENDENTE

GRUPO: EQUIPO: INTEGRANTES:


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PROFESOR:

JULIO CESAR SOSA SAVEDRA

FECHA DE REALIZACIN: ______________________ FECHA DE ENTREGA: COMENTARIOS:


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1 OBJETIVO GENERAL Aprender la correcta aplicacin y buen funcionamiento de los contadores asncronos en secuencia ascendente y descendente con ayuda del uso del Flip-Flop tipo JK. 2 OBJETIVO ESPECFICO Implementar un circuito contador asncrono ascendente / descendente con una entrada de control X; si X=1 contar de forma descendente, si X=0 contar de forma ascendente. 3 MATERIAL Y EQUIPO EMPLEADO 1 Capacitor de 0.01mF. 1 Capacitor de 1mF. 1 Resistencia de 56KW. 1 Resistencia de 15KW. 2 C.I. LSN74N08 (AND). 1 C.I. LSN74N32 (OR). 2 C.I. LSN74N73A (Flip-Flop JK). 1 C.I. 555 (Temporizador)

4 INTRODUCCIN En los contadores asncronos a diferencia de los contadores sincronos, la transicin de salida del flip-flop sirve como una fuente para disparar otro flip-flop, es decir, las entradas CP de todos los flip-flops (excepto el primero) se disparan no por los pulsos que llegan, sino ms bien por la transicin que ocurre en otros flip-flops. El cambio de estado de un flip-flop particular depende del estado presente en otros flipflops. Un contador binario asncrono ascendente consta de una conexin en serie de flipflops complementarios (tipo C o JK), con la salida de cada flip-flop conectada a la entrada CP del siguiente flip-flop de orden ms alto. El flip-flop que retiene el bit menos significativo recibe los pulsos de acarreo que llegan. En la figura 1 se muestra un contador binario asncrono de 4 bits.

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Figura 1. Contador asncrono ascendente de 4 bits Todas las entradas J y K son iguales a 1. El circulo pequeo en la entrada CP indica que el flip-flop se complementa durante una transicin que pasa a negativo o cuando la salida a la cual esta conectado pasa de 1 a 0. En la tabla 1 se muestra la secuencia de conteo de un contador asncrono ascendente. A3 A2 A1 A0 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 Tabla 1. Secuencia de conteo de un contador asncrono ascendente de 4 bits El bit A0 de orden ms bajo se complementa con cada pulso de conteo, cada vez que A0 pasa de 1 a 0 se complementa A 1; cada vez que A1 pasa de 1 a 0 se complementa A2 y cada vez que A2 pasa de 1 a 0 se complementa A3. Si se desea construir un contador asncrono descendente se construye conectando la entrada CP de cada flip-flop (excepto el primero) debe conectarse a la salida Q del flip-flop previo. Entonces cuando Q pasa de 0 a 1, Q pasara de 1 a 0 y complementa el siguiente flip-flop como se requiere.

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Figura 2. Contador asncrono descendente de 4 bits La secuencia de conteo de un contador asncrono descendente se muestra en la tabla 2. A3 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 A2 A1 1 1 1 1 1 0 1 0 0 1 0 1 0 0 0 0 1 1 1 1 1 0 1 0 0 1 0 555 1 0 0 0 0
Circuito contador

A0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0

Tabla 2. Secuencia de conteo de un contador asncrono descendente de 4 bits asncrono


ascendente / descendente

5 DESARROLLO
3 2 1 0 Para el desarrollo de la prctica el alumno deber basarse en el diagrama a bloques Convertidor de binario a BCD del contador asncrono de la figura 3.

A A

4 Decodificador BCD a 7 segmentos 7

4 Decodificador BCD a 7 segmentos 7

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Figura 3. Diagrama a bloques del contador asncrono El alumno implementar la tabla de estados del contador, as como tambin presentar las ecuaciones de excitacin para los flip-flops usados y dibujar el circuito contador en BCD de 4 bits. El conteo debe ser ascendente y descendente. 6 CONCLUSIONES (Son individuales) 7 BIBLIOGRAFIA Diseo Digital M. Morris Mano Prentice Hall El alumno puede consultar otras bibliografas y deber anotar la referencia de estas.

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