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)
((( )
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V3
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U1B
U1A
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
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CUESTIONARIO
1. Simular cada uno de los ejemplos desarrollados empleando el Circuit
Maker
PARA F1 (funcin original)
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OUTPUT 0
INPUT 0001
OUTPUT 0
INPUT 0010
OUTPUT 0
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U3A
U2B
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C
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B
0V
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1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
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INPUT 0110
OUTPUT 1
INPUT 0111
OUTPUT 1
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OUTPUT 0
INPUT 1001
OUTPUT 0
INPUT 1010
OUTPUT 0
INPUT 1011
OUTPUT 0
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OUTPUT 0
INPUT 1101
OUTPUT 0
D
0V
C
5V
B
5V
A
0V
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B
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B
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A
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L1
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
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INPUT 1110
OUTPUT 0
INPUT 1111
OUTPUT 0
PARA F2 (funcin original)
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OUTPUT 0
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OUTPUT 0
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D
0V
C
5V
B
5V
A
5V
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D
5V
C
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C
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A
0V
D
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C
0V
B
0V
A
0V
D
0V
C
5V
B
0V
A
0V
D
5V
C
5V
B
0V
A
0V
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
Pgina 40
INPUT 0100
OUTPUT 0
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OUTPUT 1
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OUTPUT 1
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OUTPUT 1
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OUTPUT 0
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OUTPUT 0
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INPUT 1011
OUTPUT 1
D
0V
C
0V
B
5V
A
0V
D
5V
C
0V
B
5V
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0V
D
0V
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B
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5V
C
5V
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0V
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B
0V
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5V
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A
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D
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A
5V
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
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INPUT 1100
OUTPUT 1
INPUT 1101
OUTPUT 1
INPUT 1110
OUTPUT 1
INPUT 1111
OUTPUT 1
PARA F3 (funcin original)
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OUTPUT 0
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OUTPUT 1
D
0V
C
0V
B
5V
A
5V
D
5V
C
0V
B
5V
A
5V
D
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A
5V
D
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B
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A
5V
D
C
B
A
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0V
U2A
U1C
U1B
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L1
D
C
B
A
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V3
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U2A
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L1
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Ing. Humberto Salazar
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INPUT 0010
OUTPUT 0
INPUT 0011
OUTPUT 1
INPUT 0100
OUTPUT 0
INPUT 0101
OUTPUT 0
INPUT 0110
OUTPUT 0
INPUT 0111
OUTPUT 1
INPUT 1000
OUTPUT 0
INPUT 1001
OUTPUT 0
D
C
B
A
V4
0V
V3
5V
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0V
U2A
U1C
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B
A
V4
5V
V3
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V2
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U2A
U1C
U1B
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L1
D
C
B
A
V4
0V
V3
0V
V2
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V1
0V
U2A
U1C
U1B
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L1
D
C
B
A
V4
5V
V3
0V
V2
5V
V1
0V
U2A
U1C
U1B
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D
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B
A
V4
0V
V3
5V
V2
5V
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U2A
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D
C
B
A
V4
5V
V3
5V
V2
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U2A
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V3
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V2
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U2A
U1C
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L1
D
C
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5V
V3
0V
V2
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V1
5V
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L1
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
Ing. Humberto Salazar
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INPUT 1010
OUTPUT 0
INPUT 1011
OUTPUT 1
INPUT 1100
OUTPUT 0
INPUT 1101
OUTPUT 0
INPUT 1110
OUTPUT 0
INPUT 1111
OUTPUT 1
2. Comparar cada uno de los circuitos desarrollados y verificar la tabla
caracterstica de cada uno de ellos.
Al simular cada uno de los casos con los obtenidos
experimentalmente, observamos que coinciden cada uno de ellos, en
las tres funciones F1, F2 y F3, cabe recalcar que valor bajo lo
D
C
B
A
V4
0V
V3
5V
V2
0V
V1
5V
U2A
U1C
U1B
U1A
L1
D
C
B
A
V4
5V
V3
5V
V2
0V
V1
5V
U2A
U1C
U1B
U1A
L1
D
C
B
A
V4
0V
V3
0V
V2
5V
V1
5V
U2A
U1C
U1B
U1A
L1
D
C
B
A
V4
5V
V3
0V
V2
5V
V1
5V
U2A
U1C
U1B
U1A
L1
D
C
B
A
V4
0V
V3
5V
V2
5V
V1
5V
U2A
U1C
U1B
U1A
L1
D
C
B
A
V4
5V
V3
5V
V2
5V
V1
5V
U2A
U1C
U1B
U1A
L1
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
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estamos considerando a un voltaje de 0.3 V y a un valor alto lo
consideramos como un voltaje de 4.7 V.
PARA LA FUNCION F1
F1 F1
PARA LA FUNCION F2
F2 F2
A B C D F1
0 0 0 0 0
0 0 0 1 0
0 0 1 0 0
0 0 1 1 0
0 1 0 0 0
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 0
1 0 1 1 0
1 1 0 0 0
1 1 0 1 0
1 1 1 0 0
1 1 1 1 0
A B C D F1
0 0 0 0 0
0 0 0 1 0
0 0 1 0 0
0 0 1 1 0
0 1 0 0 0
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 0
1 0 1 1 0
1 1 0 0 0
1 1 0 1 0
1 1 1 0 0
1 1 1 1 0
A B C D F2
0 0 0 0 0
0 0 0 1 0
0 0 1 0 0
0 0 1 1 1
0 1 0 0 0
0 1 0 1 1
0 1 1 0 0
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 1
1 0 1 1 1
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
A B C D F2
0 0 0 0 0
0 0 0 1 0
0 0 1 0 0
0 0 1 1 1
0 1 0 0 0
0 1 0 1 1
0 1 1 0 0
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 1
1 0 1 1 1
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
Podemos observar en
ambas tablas que el
comportamiento de la
funcin es el mismo en
ambos casos, por lo
tanto se realizo uno
adecuada reduccin
Podemos observar en
ambas tablas que el
comportamiento de la
funcin es el mismo en
ambos casos, por lo
tanto se realizo uno
adecuada reduccin
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
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PARA LA FUNCION F3
F3 F3
CONCLUSIONES DEL LABORATORIO
Gracias al Algebra de Boole Circuitos combinacionales digitales
complejos se puede sustituir por circuitos equivalentes mnimos.
Los niveles lgicos en las salidas de los circuitos se pueden identificar
.por medio de un LED en la prctica en serie con un resistor.
Se aprecio las diferentes formas de reducir un circuito combinacional
digital mediante el lgebra de Boole.
A B C D F3
0 0 0 0 1
0 0 0 1 0
0 0 1 0 1
0 0 1 1 1
0 1 0 0 1
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 1
1 0 0 1 1
1 0 1 0 1
1 0 1 1 1
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
A B C D F3
0 0 0 0 1
0 0 0 1 0
0 0 1 0 1
0 0 1 1 1
0 1 0 0 1
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 1
1 0 0 1 1
1 0 1 0 1
1 0 1 1 1
1 1 0 0 1
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
Podemos observar en
ambas tablas que el
comportamiento de la
funcin es el mismo en
ambos casos, por lo
tanto se realizo uno
adecuada reduccin
1 de enero de 2014 LABORATORIO DE ELECTRONICA DIGITAL
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LABORATORIO N5
Tema: Reduccin de funciones mediante mapas de karnaugh.
Objetivo: Proporcionar al alumno los mtodos de reduccin de funciones
empleando el mapa de karnaugh, aplicado a circuitos digitales.
Equipos y materiales:
Multimetro
Modulo digital
Kit de componentes digitales.
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PROCEDIMIENTO
1. Dado el circuito # 1
a Obtener su tabla de verdad y la expresin cannica en minterminos
b Aplicando karnaugh, deducir el circuito simplificado implementarlo y
comprobar su salida en F1
c Compruebe su solucin, simulando el circuito minimizado.
Solucin:
Tabla de verdad
A B C D F1
0 0 0 0 0
0 0 0 1 1
0 0 1 0 1
0 0 1 1 1
0 1 0 0 0
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 0
1 0 0 1 1
D
0V
C
0V
B
0V
A
0V
L1
U4C
U4B
U4A
U3C
U3B
U3A
U2B
U2A
U1D
U1C
U1B
U1A
D
0V
C
0V
B
0V
A
0V
L1
U4C
U4B
U4A
U3C
U3B
U3A
U2B
U2A
U1D
U1C
U1B
U1A
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Ing. Humberto Salazar
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1 0 1 0 0
1 0 1 1 1
1 1 0 0 0
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
La expresin cannica en min trminos es:
)(
) (
)
(
) (
Aplicando karnaugh se tiene:
La funcin simplificada en minterminos aplicando mapas de karnauhg es:
D C B C + + . . A
___
Y su respectivo mapa es el siguiente
Mapa de karnaugh
D C B C + + . . A
___
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Circuito simplificado
Simulacin del circuito simplificado.
INPUT 0000
OUTPUT 0
INPUT 0001
OUTPUT 1
INPUT 0010
OUTPUT 1
INPUT 0011
OUTPUT 1
D
0V
C
0V
B
0V
A
0V
L1
U2A
U3A
U1B
U1A
D
0V
C
0V
B
0V
A
0V
L1
U2A
U3A
U1B
U1A
D
5V
C
0V
B
0V
A
0V
L1
U2A
U3A
U1B
U1A
D
0V
C
5V
B
0V
A
0V
L1
U2A
U3A
U1B
U1A
D
5V
C
5V
B
0V
A
0V
L1
U2A
U3A
U1B
U1A
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INPUT 0100
OUTPUT 0
INPUT 0101
OUTPUT 1
INPUT 0110
OUTPUT 1
INPUT 0111
OUTPUT 1
INPUT 1000
OUTPUT 0
INPUT 1001
OUTPUT 1
INPUT 1010
OUTPUT 0
INPUT 1011
OUTPUT 1
D
0V
C
0V
B
5V
A
0V
L1
U2A
U3A
U1B
U1A
D
5V
C
0V
B
5V
A
0V
L1
U2A
U3A
U1B
U1A
D
0V
C
5V
B
5V
A
0V
L1
U2A
U3A
U1B
U1A
D
5V
C
5V
B
5V
A
0V
L1
U2A
U3A
U1B
U1A
D
0V
C
0V
B
0V
A
5V
L1
U2A
U3A
U1B
U1A
D
5V
C
0V
B
0V
A
5V
L1
U2A
U3A
U1B
U1A
D
0V
C
5V
B
0V
A
5V
L1
U2A
U3A
U1B
U1A
D
5V
C
5V
B
0V
A
5V
L1
U2A
U3A
U1B
U1A
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INPUT 1100
OUTPUT 0
INPUT 1101
OUTPUT 1
INPUT 1110
OUTPUT 1
INPUT 1111
OUTPUT 1
2. Dada la expresin:
+ = ) 15 , 14 , 13 , 12 , 11 , 10 ( ) 7 , 5 , 3 , 2 , 1 ( ) , , , (
0 1 2 3
d N N N N F
a) Obtener su tabla de verdad y la expresin cannica en
minterminos.
b) Aplicando karnaugh, deducir el circuito simplificado, implementarlo
y comprobar su tabla de verdad.
c) Compruebe su solucin, simulando el circuito minimizado.
D
0V
C
0V
B
5V
A
5V
L1
U2A
U3A
U1B
U1A
D
5V
C
0V
B
5V
A
5V
L1
U2A
U3A
U1B
U1A
D
0V
C
5V
B
5V
A
5V
L1
U2A
U3A
U1B
U1A
D
5V
C
5V
B
5V
A
5V
L1
U2A
U3A
U1B
U1A
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Solucin:
Tabla de verdad
N
3
N
2
N
1
N
0
F
0 0 0 0 0
0 0 0 1 1
0 0 1 0 1
0 0 1 1 1
0 1 0 0 0
0 1 0 1 1
0 1 1 0 0
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 X
1 0 1 1 X
1 1 0 0 X
1 1 0 1 X
1 1 1 0 X
1 1 1 1 X
Circuito simplificado
N2
N1
N0
N3
U6A
U4A
U3B
U3A
L1
U1A
V4
0V
V3
0V
V2
5V
V1
5V
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Expresin cannica en minterminos :
((
( )
((
( )
Tablas de karnaugh
D A C B F
___ ___
. 1 * + = D A C B F
___ ___
. 1 * + =
Compruebe su simulacin.
INPUT 0000
OUTPUT 0
INPUT 0001
OUTPUT 1
C1
0V
D1
0V
B1
0V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
5V
B1
0V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
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INPUT 0010
OUTPUT 1
INPUT 0011
OUTPUT 1
INPUT 0100
OUTPUT 0
INPUT 0101
OUTPUT 1
INPUT 0110
OUTPUT 0
INPUT 0111
OUTPUT 1
INPUT 1000
OUTPUT 0
INPUT 1001
OUTPUT 0
C1
5V
D1
0V
B1
0V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
5V
B1
0V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
0V
B1
5V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
5V
B1
5V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
0V
B1
5V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
5V
B1
5V
A1
0V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
0V
B1
0V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
5V
B1
0V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
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INPUT 1010
OUTPUT 1
INPUT 1011
OUTPUT 1
INPUT 1100
OUTPUT 0
INPUT 1101
OUTPUT 0
INPUT 1110
OUTPUT 0
INPUT 1111
OUTPUT 0
C1
5V
D1
0V
B1
0V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
5V
B1
0V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
0V
B1
5V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
0V
D1
5V
B1
5V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
0V
B1
5V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
C1
5V
D1
5V
B1
5V
A1
5V
U1C
U1D
U3B
U4B
U4C
L1
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Cuestionario
Desarrolle el siguiente diseo mediante el mapa de karnaugh.
1- El sistema de ascenso y descenso de un edificio grande consiste en seis
ascensores. las cabinas 1 a 4 forman el sistema primario, las cabinas 5
y 6 se utilizan solamente cuando hay mucho transito, permaneciendo
cerrado el resto de tiempo para ahorrar energa .Se requiere disear
un circuito lgico para detectar el estado de los cuatro carros
primarios y generar una seal de activacin cuando todos estn en uso
a fin de habilitar para su uso a los dos restantes. Se debe generar,
adems una seal de listo cuando se usen tres de las cuatro cabinas
primarias para arrancar los motores de la cabina 5 y 6 y permitir su
uso posteriormente con la seal de activacin, suponga que se dispone
de cuatro lneas denotadas por X Y W Q para indicar el estado de las
cuatro cabinas primarias, un uno en estas lneas de entrada indica
que la cabina esta en uso y un cero que esta fuera de servicio.
Disee un circuito lgico mnimo para proveer las seales apropiadas a
las cabinas emergentes, puede usar cualquier tipo de compuerta.
Suponga que solo debe producirse los niveles de voltaje lgico y que el
acoplamiento del sistema de control de los ascensores ya existe.
Obteniendo el circuito lgico minimizado, simule el circuito y
compruebe con lo hallado tericamente.
Solucin:
Tabla de verdad
X Y W Q F
0 0 0 0 0
0 0 0 1 0
0 0 1 0 0
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0 0 1 1 0
0 1 0 0 0
0 1 0 1 0
0 1 1 0 0
0 1 1 1 1
1 0 0 0 0
1 0 0 1 0
1 0 1 0 0
1 0 1 1 1
1 1 0 0 0
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
Resolvemos cada funcin haciendo uso de las tablas de karnaugh.
()
() ( ) ( )
X
Y
W
Q
F(XYWQ)
V8
0V
V7
0V
V6
0V
V5
0V
U7A
U6D
U1C
U1B
U6C
U6B
U1D
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Por medio de los mapas de karnaugh se ha modelado una funcin lgica
para el sistema de ascensores de un edificio resultando la siguiente
funcin:
() ( ) ( )
Mediante la simulacin en cicuit maker se a implementado el circuito
lgico pero debemos tener en cuenta que existen 2 condiciones que se
deben cumplir una es solamente para activar los motores cuando 3
ascensores estn ocuparos. Entonces se ha agregado al diagrama lgico
una puerta AND para diferenciar ambas condiciones. El funcionamiento
es el siguiente cuando el L1 esta encendido significa que solamente 3
cabinas estn en funcionamiento y se deben activar los motores (seal
de listo) y cuando ambos led se encienden L1 y L2 significa que las 4
cabinas estn en funcionamiento y se deben activar las cabinas 5 y 6
(seal de activacin).Se ha incluido la simulacin para los casos en que
se usan 3 cabinas ,para el caso en que estn en uso todas las cabinas del
sistema primario y algunos casos en que no se necesitan ni encender los
motores ni activar las cabinas 5 y 6.
Simulacin para la seal de listo (uso de 3 cabinas del sistema
primario)
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Simulacin para la seal de activacin (todo el sistema primario
funcionando)
Luego complementamos estas funciones con compuertas AND y en cada
salida de la funcin dada colocamos un indicador que de las seales de
habilitado inhabilitado listo y activacin.
El LED de la funcin uno F1 nos indica si esta habilitado (LED
encendido), o esta inhabilitado (LED apagado) , para el caso del segundo
led que se encuentra en la salida entre F1 y F2 , el LED encendido nos
indica que tres ascensores estn funcionando y manda una seal de
LISTO y apagado significa que dos o menos estn funcionando , y para
el tercer LED encendido que se encuentra entre ( F1 Y F2 ) con F3 nos
indica que los cuatro ascensores estn funcionando y por lo tanto manda
la seal de ACTIVACION . El circuito esta implementado con
compuertas AND
3 ). 2 . 1 ( F F F FT =
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Circuito resultante:
EJEMPLOS
Q
0V
W
0V
Y
0V
X
0V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
Q
0V
W
0V
Y
0V
X
5V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
do inhabilita habilitado_
" "LISTO
" " ACTIVADO
HABILITADO
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Q
0V
W
5V
Y
0V
X
5V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
Q
0V
W
5V
Y
5V
X
5V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
HABILITADO
HABILITADO
LISTO
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Q
5V
W
5V
Y
0V
X
5V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
Q
5V
W
5V
Y
5V
X
5V
L3
L2
L1
U5B
U5A
U1B
U4A
U3A
U2C
U2B
U2A
U1A
LISTO
HABILITADO
HABILITADO
LISTO
ACTIVADO
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LABORATORIO N6
Tema: Diseo de circuitos combinacionales.
Objetivo: Proporcionar al alumno los mtodos de diseo para realizar
circuitos combinacionales con funciones especficas.
Equipos y materiales:
Multimetro
Modulo digital
Kit de componentes digitales.
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PROCEDIMIENTO
PRIMERA PARTE
1- Dado el circuito combinacional medio sumador
a.- Obtener la tabla de verdad, los mapas de k y la expresin cannica
del circuito.
Tabla de verdad
A B Cy S
0 0 0 0
0 1 0 1
1 0 0 1
1 1 1 0
Mapas de karnaugh
Cy S
Expresin cannica
Simulacin
s
cy
B
0V
A
0V
L2
L1
U2A
U1A
74LS86
cy
s
B
5V
A
0V
L2
L1
U2A
U1A
74LS86
s
cy
B
0V
A
0V
L2
L1
U2A
U1A
74LS86
b a S
b a b a S
=
+ =
__ ___
. .
b a C
y
.. =
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2- Dado el circuito combinacional sumador completo
a.- Obtener la tabla de verdad , los mapas de k y la expresin cannica
del circuito.
Tabla de verdad
A B C Cy S
0 0 0 0 0
0 0 1 0 1
0 1 0 0 1
0 1 1 1 0
1 0 0 0 1
1 0 1 1 0
1 1 0 1 0
1 1 1 1 1
Mapas de karnaugh
Expression cannica
c b c a b a Cy . . . + + =
__ __ __ __ __ __
c b a abc c b a c b a S + + + =
s
cy
B
0V
A
5V
L2
L1
U2A
U1A
74LS86
s
cy
B
5V
A
5V
L2
L1
U2A
U1A
74LS86
S
Cy
C
0V
B
0V
A
0V
L2
L1
U3A
U2B
U1B
U2A
U1A
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3- Dado el circuito combinacional tipo multiplicador de dos palabras de 2
bits
a.- Obtener la tabla de verdad los mapas de karnaugh y la expresin
cannica del circuito
a1 a0 b1 b0 p3 p2 p1 p0
0 0 0 0 0 0 0 0
0 0 0 1 0 0 0 0
0 0 1 0 0 0 0 0
0 0 1 1 0 0 0 0
0 1 0 0 0 0 0 0
0 1 0 1 0 0 0 1
0 1 1 0 0 0 1 0
0 1 1 1 0 0 1 1
1 0 0 0 0 0 0 0
1 0 0 1 0 0 1 0
1 0 1 0 0 1 0 0
1 0 1 1 0 1 1 0
1 1 0 0 0 0 0 0
1 1 0 1 0 0 1 1
1 1 1 0 0 1 1 0
1 1 1 1 1 0 0 1
Mapas de karnaugh
Donde:
p3
p2
p1
p0
b0
0V
b1
0V
a0
0V
a1
0V
L4
L3
L2
L1
U4A
U3B
U3A
U1D
U1C
U2A
U1B
U1A
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d c b a p . . . 3 =
__ __
2 d ac c b a p + =
__ __ __ __
1 d bc bc a d b a d c a p + + + =
d b p .
0
=
A B C C1 S
0 0 0 0 0
0 0 1 0 1
0 1 0 0 1
0 1 1 1 0
1 0 0 0 1
1 0 1 1 0
1 1 0 1 0
1 1 1 1 1
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CUESTIONARIO
1. Disee, empleando los mapas de Karnaugh, por lo menos tres
circuitos diferentes que realicen la funcin de sumadores completos.
En un sumador total o completo tenemos:
PRIMERA FORMA
Para C1 tenemos:
C B C A B A C . . . 1 + + =
Para S tenemos:
C B A S
B A C B A C S
B A B A C B A AB C S
C B A C B A C B A C B A S
=
+ =
+ + + =
+ + + =
) ( ) ( .
) . ( ) (
. . . . . . . .
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El primer circuito es:
SEGUNDA FORMA
Para C1 tenemos:
) ).( ).( ( 1 C B C A B A C + + + =
Para S tenemos:
C B A S =
C1
S
C
0V
B
0V
A
0V
L2
L1
U3A
U2B
U2A
U1C
U1B
U1A
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El segundo circuito es:
TERCERA FORMA
Para C1 tenemos:
B A B A C C
C C B A B A C C
C B A B A C B A C C
C B A B A B A C C
C B A AB B A B A C C
ABC C B A C B A C B A C
. ) .( 1
) ( . ) .( 1
. . . . ) .( 1
. . ) . ( 1
. . ) . .( 1
. . . . . . 1
+ =
+ + =
+ + =
+ + =
+ + + =
+ + + =
Para S tenemos:
C B A S =
S
C1
C
0V
B
0V
A
0V
L2
L1
U3A
U2B
U2A
U1C
U1B
U1A
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El tercer circuito es:
2. Disee un restador medio y un restador completo
La tabla de operacin de un restador medio es:
Para R tenemos:
B A R
B A B A R
=
+ = . .
El circuito es:
La tabla de verdad de un restador completo es:
Para C1 tenemos:
C1
S
V3
0V
V2
0V
V1
0V
L2
L1
U3A
U2B
U1B
U2A
U1A
R
B
0V
A
0V
U1A
L1
A B R
0 0 0
0 1 1
1 0 1
1 1 0
A B C C1 R
0 0 1 1 0
0 1 1 0 1
1 0 1 1 1
1 1 1 1 0
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B A C + = 1
Para R tenemos:
B A R
B A B A R
=
+ = . .
El circuito es:
R
C1
B
0V
A
0V
L2
L1
U1A
U3A
U2A