Informe Previo Laboratorio 7

Informe
Previo
Laboratorio
7
E.A.P. Ing. De Sistemas e Informatica

2011

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2011

UNIVERSIDAD NACIONAL
MAYOR DE SAN MARCOS
Ao del Centenario de Machu Picchu para el Mundo

E.A.P
:
Ingeniera de Sistemas e Informtica
CICLO

:
2011-Il

CURSO

:
Circuitos Digitales

TEMA

:
Informe Previo Laboratorio 7

APELLIDOS Y NOMBRES:
RETAMOZO CORDOVA, Jean Pierre Steve.

PROFESOR :
Ing. Oscar Casimiro Pariasca
FECHA DE ENTREGA:
Jueves 3 de Noviembre 2011
HORA DE ENTREGA:
13:00 Horas

COD: 10200204

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LABORATORIO DE CIRCUITOS DIGITALES

Laboratorio 7: Contadores

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I. OBJETIVO
Disear circuitos secuenciales autnomos (contadores) utilizando CIs
estndar.

ll. CUESTIONARIO PREVIO

1.- Describir el modo de operacin del CI 74LS90, CI 74LS93 , CI
74LS154 y del CI 74LS193.
CI74LS193
Dispositivo constituye un contador decimal asncrono reversible con entrada
paralela, preparado para efectuar el conteo decimal en cdigo binario BCD. Las
entradas y salidas son totalmente compatibles con dispositivos TTL, NMOS y
CMOS, con un ancho de operatividad de 4,5V a 5,5V.
CI 74LS93
El contador 7493 utilizan 4 flip-flops JK en modo de conmutacin, como se muestra
en la siguiente figura cuenta con entradas de reloj P0 y P1 en donde P1 es la
entrada de reloj del segundo flip-flop por lo que para formar un contador de 4 bits
mod-16 hay que conectar la salida del primer flip-flop de manera externa (puente)
con la entrada P1, quedando P0 como la entrada de reloj del contador.
Tambin tiene dos entradas de reset (MR1 y MR2) las cuales no se deben dejar
desconectadas (flotando) porque, como estas se activan en ALTA, al estar flotando
toman un nivel ALTO lo que mantendra en reset al contador.

Fig 1.1 74LS93

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CI74LS154
Es un C.I. con cuatro lneas de entrada, 2^4=16 lneas de salida. Dos lneas de
habilitacin. Sus salidas son activas a nivel bajo esto quiere decir que si sus
entradas est el numero 0011 la salida Q3 estar a nivel bajo y las dems sern
alto.

Fig 1.2 74L154

CI 74LS90
El 7490 es un contador de dcadas BCD. Est construido a base de flip-flops o
latches.

Fig 1.2 74LS90

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2.- Qu significa el trmino mdulo en relacin a los contadores?

El nmero mximo de estados por los que pasa un contador se denomina mdulo
del contador. Este nmero viene determinado por la expresin 2^n donde n indica
el nmero de bis del contador.
Ejemplo: un contador de mdulo 4 pasa por 4 estados, y contara del 0 al 3.
Si necesitamos un contador con un mdulo distinto de 2^n lo que haremos es
aadir un circuito combinacional (puerta NAND) cuyas entradas sean las salidas a 1
del contador, y aadir la salida del circuito a todas las entradas CLEAR de los
biestables.
Un contador MOD-k tiene k estados y estos se pueden implementar con n
biestables (Flip-Flop), existiende una relacin entre k y n dada por
2^(n-1) <=K<= 2^(n).

3. En qu se diferencia un contador sncrono de uno asncrono?

Sncrono

Es aquel contador que va en un solo tiempo. Por ejemplo podemos poner a

los relojes digitales, su segundero es un contador sncrono ya que avanza de
segundo en segundo.
Asncrono

es aquel contador que su tiempo va desacuerdo con el ritmo. Por ejemplo

en el primer tiempo puede durar 4 segundos y el segundo tiempo puede
durar 6 segundos y se puede ir as.

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4. Cuntos estados tiene un contador de mdulo 14? Cul es el

mnimo nmero

de flip-flops

requerido para

implementar este

contador?
Si tenemos un MOD-14, es decir un contador con 14 estados, cuenta desde 0 hasta
13, este requiere 4 FF, ya que sabemos que los estados son una potencia de 2.
Entonces procedemos con la siguiente aseveracin.
3

2 <14<2

Esto quiere decir que con 3 FF se tienen 8 estados mientras que con 4 FF se
obtienen 16 estados. Es evidente que los estados sobrantes se pierden.

5. Disear un contador de mdulo 6 con el CI 74LS90. Determinar la

relacin que hay entre las frecuencias de las seales en las salidas de
los flip-flop con la frecuencia de la seal de reloj.
Para conseguir este tipo de contador de bits, se utiliza una entrada de reset o
borrado la cual se activa inmediatamente despus de la cuenta ms alta que se
necesite, en este caso en la cuenta 110, colocando los flip-flops en 0 lgico. En la
figura 5.1 se muestra el esquema de un contador mod-6.

Fig 5.1 Esquema Logico contador

Este trabajo de activar las entradas de reset de cada flip-flop lo realiza una puerta
NAND la cual da un 0 lgico a las entradas de reset. Al recibir en las entradas de la
NAND los 1 lgicos de las salidas del FF2 y del FF3 colocando en 0 lgico todos los
flip-flops y as el contador comienza de nuevo a contar desde 000 hasta 101 o
inversamente si es de cuenta descendente.

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C B A Cuenta decimal
0 0 0 0
0 0 1 1
0 1 0 2
0 1 1 3
1 0 0 4
1 0 1 5
1 1 0
1 1 1

RESET

Tabla 5.1 Secuencia del contador mod-6

Fig 5.2 Diagrama de tiempos mod-6

El retardo que es causado en el pulso 6 cuando va del nivel ALTO a BAJO hasta
que FF2 y FF3 son puestos a 0 en el punto B del diagrama de tiempo, se le
denomina tiempo de propagacin y ste depende del retardo de propagacin del
flip-flop y de la puerta que se est utilizando, este retardo de propagacin en la
familia TTL es del orden de unos 30ns (nanosegundos). En las otras familias son
mayores.

6. Analizar el funcionamiento de los circuitos de la parte experimental.

Analizaremos entonces el Circuito Integrado 74LS93, usado en la experiencia.
Funcionamiento CI74LS93
Si conectamos el circuito como un contador de 4 bits usando la entrada A y
conectando la salida Qa al terminal de entrada B. Las entradas R1 y R2 deben
estar a tierra, Los terminales 5 y 10 se conectan a la fuente de 5 V c.c. Los pulsos
se aplican a la entrada 14 (A). La salida Qa corresponde al bit menos significativo.
Se Observa que la frecuencia de reloj en la salida del primer FF es la mitad que la
frecuencia de entrada del reloj. Cada FF subsiguiente reduce a la mitad la

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frecuencia que recibe. El contador de 4 bits divide la frecuencia de entrada entre 16

en la salida Qd

Fig 6.1 74LS93

Conectamos el CI 74LS93 como contador BCD. La representacin BCD emplea los

nmeros binarios del 0000 al 1001 para codificar los nmeros decimales del 0 al 9.
Como ejemplo usamos un diagrama temporal de seales en las salidas del
contador, considerando 10 ciclos de reloj.

Fig 6.2 Diagrama Temporal

74LS93

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lll. BIBLIOGRAFA
ladelec.com
URL: http://ladelec.com/teoria/electronica-digital/201-contadorde-rizado-modulo-6
Fecha de visita: Martes 1 de Noviembre del 2011
Scribd.com
URL: http://es.scribd.com/doc/52654885/Aplicaciones-de-los-F-F
-Contadores-asincronos-13328
Fecha de visita: Martes 1 de Noviembre del 2011
uhu.es
URL:http://www.uhu.es/adoracion.hermoso/sist_digit/documen
tos/Hoja_caract_CI.pdf
Fecha de visita: Lunes 31 de Octubre del 2011
Diseo Digital Principios y Practicas, Jhon F. Wakerly,
Prentice Hall, 2001, Cap. 9, pg. 556-560.