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Flores Andy
Masache Jefferson
2. IMPLEMENTACION DE LA ALU
ALU
O0
1
0
1
1
O1
O2
O3
B0
B1
B2
B3
RELOJ
RELOJ
C0
C1
C2
C3
CCT005
0
0
0
1
0
1
1
1
A0
A1
A2
A3
0
0
0
1
UNIDAD LOGICA
A0
A1
A2
A3
A0
A1
A2
A3
S0
S1
S2
S3
U11
6
5
4
3
CCT010
B0
B1
B2
B3
B0
B1
B2
B3
C0
C1
C0
C1
10
11
12
13
14
2
1
15
UNIDAD ARITMETICA
A0
A1
A2
A3
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
O0
O1
A
B
1E
2E
74LS153
U12
R0
R1
R2
R3
6
5
4
3
10
11
12
13
CCT017
B0
B1
B2
B3
14
2
1
15
C0
C1
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
O2
O3
A
B
1E
2E
74LS153
A0
A1
A2
A3
RELOJ
C2
C3
UNIDAD DE TRANSICION
Q0
Q1
Q2
Q3
R0
CCT018
C0
C1
UNIDAD LOGICA
U1:A
U1:B
A0
B0
A1
6
5
B1
74LS08
74LS08
U2:A
U2:B
A0
B0
74LS32
74LS32
10
11
12
13
U3:B
4
A1
1
3
6
5
B1
B0
6
5
4
3
6
5
B1
U3:A
A0
U5
A1
3
2
14
2
1
15
74LS86
U4:B
74LS86
U4:A
1
A0
A1
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
S0
S1
A
B
1E
2E
74LS153
74LS04
74LS04
U1:C
B2
U1:D
9
8
10
A3
B3
74LS08
12
11
13
B2
8
10
A3
B3
12
11
13
U3:D
9
8
10
A3
B3
74LS86
12
11
74LS86
U4:D
6
74LS04
14
2
1
15
13
U4:C
A2
10
11
12
13
74LS32
U3:C
B2
6
5
4
3
U2:D
74LS32
A2
U6
74LS08
U2:C
A2
A3
13
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
A
B
1E
2E
74LS153
12
74LS04
C0
C1
A2
S2
S3
UNIDAD ARITMETICA
U8
U4:E
B0
11
B0
10
74LS04
U4:F
B1
B1
8
74LS04
6
5
4
3
10
11
12
13
14
2
1
15
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
U7
7
5
3
14
12
A0
A1
A2
A3
6
2
15
11
A
B
1E
2E
C0
A0
A1
A2
A3
S0
S1
S2
S3
4
1
13
10
R0
R1
R2
R3
B0
B1
B2
B3
C0
C4
74LS283
74LS153
U9
U10:A
B2
B2
2
74LS04
U10:B
B3
B3
4
74LS04
6
5
4
3
10
11
12
13
14
2
1
15
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
A
B
1E
2E
C0
C1
74LS153
UNIDAD DE TRANSICION
6
5
4
3
Q1
A3
A0
10
11
12
13
14
2
1
15
1X0
1X1
1X2
1X3
1Y
2X0
2X1
2X2
2X3
2Y
2
3
12
R0
11
S
R
1
R
10
S
Q2
CLK
8
74LS74
U16:A
Q1
CLK
A
B
1E
2E
74LS153
C0
C1
U15:B
U14
Q2
Q0
A1
74LS74
13
11
74LS153
Q3
12
CLK
A
B
1E
2E
2Y
14
2
1
15
2X0
2X1
2X2
2X3
74LS74
10
10
11
12
13
1Y
U16:B
Q3
Q1
A2
1X0
1X1
1X2
1X3
6
5
4
3
CLK
13
A0
Q2
A3
U15:A
U13
8
74LS74
Q0
C C C C
0 1 2 3
0 0 0 0
0 0 0 1
0 0 1 0
0 0 1 1
0 1 0 0
0 1 0 1
0 1 1 0
0 1 1 1
1 0 0 0
1 0 0 1
1
1
1
1
1
1
0
0
1
1
1
1
1
1
0
0
1
1
0
1
0
1
0
1
OPERACI
N
A AND B
A OR B
A EXOR B
NOT A
A+B
A-B
A+1
A-1
PARALEL
O
RESET
X
X
X
X
Como salidas tiene los 4 bits del resultado, ms una salida comparador (A
= B) y salidas de acarreo.
Como curiosidad decir que este circuito integrado trabaja con lgica inversa
en las entradas de datos y en las salidas, es decir, que para estos pines se
invierte el significado de los 1 y los 0. Aunque es posible hacerlo trabajar
con lgica directa. (Catedu, 2011)
Configuracin de pines del CI 74LS181
La ALU 74LS381
Muchas de las funciones disponibles en la 74LS181 son de poco valor
prctico. En respuesta a esto, los fabricantes de ALUs han introducido al
mercado el circuito integrado 74LS381, el cual implementa a una ALU un
poco ms pequea y sencilla. En la figura N 7 se muestra su configuracin
de pines, la asignacin de funciones de cada uno de ellos y su tabla de
funciones. Observe que solo se dispone de tres lneas de seleccin y que
no existe un pin de seleccin de modo, M, por lo cual este dispositivo solo
puede desollarse ocho funciones en total. Estas corresponden a las
operaciones aritmticas y lgicas de ms frecuente uso.
(Irlenys, 2005)
Bibliografa
Catedu. (2 de Agosto de 2011). Educativa Catedu. Recuperado el 2015 de
Septiembre de 30, de http://educativa.catedu.es/44700165/aula/archivos/repositorio/4750/4923/ht
ml/10_otros_circuitos_lgicos_alu.html
Irlenys, T. (23 de 12 de 2005). Circuitos Aritmticos. Recuperado el 2015 de
Septiembre de 30, de
http://irlenys.tripod.com/digitalesi/arit/suma.htm