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Sistemas Digitais

Professora Stphany Vergtz

Sistemas Digitais - Stphany Vergtz

Registradores de Deslocamento Shift


Register
O Flip-Flop pode armazenar um nico bit na sada Q, que
muda a cada pulso do CLOCK, e a informao anterior
perdida.
Para armazenar uma informao de mais de 1 bit, pode-se
utilizar o registrador de deslocamento.
O Registrador de deslocamento um circuito constitudo de
Flip-Flop JK mestre-escravo, ligados de tal maneira que as
sadas ( Q e Q ), de cada bloco, sejam aplicadas nas entradas J
e K do FF vizinho ( Q J e Q K , podendo utilizar o FF tipo
D).
O primeiro FF do tipo D.
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Registradores de Deslocamento Shift


Register

Registrador de Deslocamento de 4 bits com FF do tipo D

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Registradores de Deslocamento Shift


Register

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Registradores de Deslocamento Shift


Register

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Registradores de Deslocamento Shift


Register

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Registradores de Deslocamento Shift


Register

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Registradores de Deslocamento Shift


Register

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Registradores de Deslocamento Shift


Register

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Conversor Srie-Paralelo

Ex: Informao Serial Informao Paralela


Entrada Serial: ES = 1010 (I3I2I1I0)
onde I3 o MSB e I0 o LSB. O LSB enviado primeiro.
Sada Paralela: Q3 = 1, Q2 = 0, Q1 = 1, Q0 = 0
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Conversor Srie-Paralelo
ES = 1010 (I3I2I1I0) Sada Paralela: Q3 = 1, Q2 = 0, Q1 = 1, Q0 = 0
- Inicialmente todas as sadas so
zeradas.
- Aps a 1 descida do CLK, a
informao I0 = 0 enviada para a
sada Q3.
- Aps a 2 descida do CLK, a
informao I1 = 1 enviada para a
sada Q3 e a informao I0 = 0
armazenada na sada Q2.
- Assim sucessivamente.

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Conversor Srie-Paralelo
ES = 1010 (I3I2I1I0) Sada Paralela: Q3 = 1, Q2 = 0, Q1 = 1, Q0 = 0
Informao

Descida do CLK

Q3

Q2

Q1

Q0

I0

I1

I2

I3

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Conversor Paralelo-Srie

Conversor Paralelo-Srie de 4 bits

P3 , P2 , P1 , P0 a entrada paralela. A sada serial ser obtida


na sada Q0 aps 3 descidas do CLK.
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Conversor Paralelo-Srie

Analisando apenas uma parte do circuito:


p/ CLR = 0 Q = 0 (independente de qualquer
entrada , considerando PR = 1)
p/ ENABLE = 0 PR = 1 (o FF atua normalmente,
considerando CLR = 1)
p/ ENABLE = 1 e P = 1 PR = 0 Q = 1
(independente de qualquer entrada, considerando
CLR = 1)
p/ ENABLE = 1 e P = 0 PR = 1 Q mantm seu
estado (at o prximo pulso do CLK, considerando
CLR = 1)
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Conversor Paralelo-Srie
Inicialmente zera-se todas as sadas, utilizando o comando CLR = 0,
ento Q3 = Q2 = Q1 = Q0 = 0.
Aplica-se a informao paralela I3, I2, I1 e I0 nas entradas P3, P2, P1 e P0 .
Com o ENABLE ativado (ENABLE = 1), as sadas Q3 , Q2 , Q1 e Q0
assumiro os bits da informao paralela.
Desativando o ENABLE (ENABLE = 0) os FF atuam normalmente e a
informao ser deslocada a cada pulso do CLK.
Aps 3 descidas do CLK, a informao serial obtida.
ENABLE

Descida do CLK

Sada Serial

Q0 = I0

Q0 = I1

Q0 = I2

Q0 = I3

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Registrador de Deslocamento utilizado


como Multiplicador ou Divisor por 2
Ex:
01002 = ?10
?2 = ?10
?2 = ?10
00102 = ?10
?2 = ?10
?2 = ?10

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Registrador de Deslocamento utilizado


como Multiplicador ou Divisor por 2
Ex:
01002 = 410
00102 = 210 (deslocando para direita divide por 2)
10002 = 810 (deslocando para esquerda multiplica por 2)
00102 = 210
00012 = 110 (deslocando para direita divide por 2)
01002 = 410 (deslocando para esquerda multiplica por 2)

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Registrador de Deslocamento utilizado


como Multiplicador ou Divisor por 2
Divisor por 2 (deslocamento a direita)

Antes do pulso do CLK

Aps um pulso do CLK

Multiplicador por 2 (deslocamento a esquerda)

Antes do pulso do CLK

Aps um pulso do CLK


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Referncias Bibliogrficas
TOCCI, Ronald J. et al. Sistemas Digitais: princpios e aplicaes. 11.
ed. So Paulo: Pearson Prentice Hall, 2011.

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