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2012
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ndice
1 TEORIA GERAL DA AUTOMAO ...........................................................................................................3
2 TEORIA GERAL DE CONTROLADORES LGICOS PROGRAMVEIS..................................................3
2.1
2.2
2.3
2.4
2.5
Arquitetura de hardware..................................................................................................................3
2.3.1
Fonte.......................................................................................................................................3
2.3.2
Mdulo de comunicao.........................................................................................................3
2.3.3
2.3.4
Sadas Digitais........................................................................................................................3
2.3.5
2.3.6
UCP ........................................................................................................................................3
2.4.2
2.5.2
3.2
3.3
3.2.1
3.2.2
3.2.3
3.2.4
3.2.5
3.2.6
3.2.7
3.2.8
3.2.9
3.2.10
3.3.2
Aes em SFC........................................................................................................................3
3.4
3.5
Linguagem ST .................................................................................................................................3
4.2.2
2 / 84
Soft-starters ............................................................................................................................3
4.3.2
4.3.3
4.3.4
3 / 84
a) Automao fixa;
b) Automao programvel, e;
c) Automao flexvel.
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Alto
Variedade
Da
produo
Mdio
Automao
programvel
Baixo
Automao fixa
Automao
flexvel
Baixo
Mdio
Alto
Volume da produo
Entradas e dispositivos de
campo
B1
B2
B3
B4
L1
L2
L3
L4
L5
L6
L7
L8
M1
M3
M2
Sadas e dispositivos
de campo
A1
6 / 84
B1
R1
B3
R2
B2
R3
B4
B4
R1
E1a E1b
C1
E2a
E2b
C2
E3a
E3b
C3
E4a
E4b
C3
10
R2
11
R3
10
R4
11
Figura 3 - Ilustrativo parcial de um circuito eltrico com rels e contadores.
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2.2 Histrico
arquitetura
de
hardware
dos
Controladores
Programveis
O desenvolvimento do CLPs (Controladores Lgicos Programveis) ou CPs
(Controladores Programveis) comeou por volta de 1968 quando a General Motors
solicitou indstria eletrnica uma alternativa tecnolgica de um equipamento de estado
slido e programvel para a implementao da automao at ento implementada em
painis de comando repletos de dispositivos eletromecnicos.
As principais razes que motivaram essas solicitaes foram:
a) O sistema de rel utilizado na automao das linhas de manufatura, de
montagem, de carregamento e de controle de mquinas havia se tornado
grande e complexo.
b) Necessidade do melhorar os ndices de confiabilidade e de diminuir os custos
de manuteno dos sistemas de automao.
c) Necessidade de se ter flexibilidade e agilidade nas implementaes e nas
alteraes das plantas automatizadas e nos seus respectivos sistemas de
automao.
Os Controladores Lgicos Programveis so equipamentos de estado slido
projetados inicialmente para substituir as aes dos rels e temporizadores num circuito
de intertravamento como o mostrado no exemplo anterior. Entretanto, os CLPs atuais
incorporam
funes
avanadas
como:
controle
estatstico,
controle
de
malha,
PROCESSO
Reles, contadores,
Sensores mecnicos,
vlvulas, lmpadas,
etc.
etc
Cartes de Sada
Cartes de Entrada
UCP
FONTE
MEMRIA
DISPOSITIVO DE PROGRAMAO
IMPRESSORA
MONITOR
DISPLAY
Deve-se ressaltar que os CLPs tiveram uma grande evoluo na sua capacidade de
programao e de execuo de tarefas. No incio dos anos 2000 surgiu uma nova
gerao de CLP denominada da PAC ou CAP (Controlador de Automao Programvel)
Um CAP possui tanto a elevada confiabilidade de hardware dos CLPs, quanto a
elevada
capacidade
de
processamento
quantidade
de
memria
dos
funes dos dois tipos de sistemas de automao SDCD e CLP conjuntamente com
SCADA possam ser unificados em um nico tipo de sistema. Os CAP permitem rodar
programas complexos, elaborados em linguagem de alto nvel, conforme as necessidades
do sistema de automao. Os PACs so controladores com capacidade de lidar com
controles envolvendo lgica, movimento motion e processo num mesmo controlador.
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CLP
+24V
ED
+24V
ED
CPU
CPU
Ch
E
Fonte
auxiliar
24VCC
FONTE
Fonte
auxiliar
24VCC
E
Ch
FONTE
0V
0V
Nas duas configuraes das figuras 7a e 7b, o sinal de 0/24VCC na entrada digital
aplicado a um amplificador isolador, responsvel pelo isolamento galvnico eltrico entre
os ambientes eltricos do processo e da UCP. A isolao usual de tenso de 2500VCA.
Na maioria dos casos a isolao eltrica provida via acopladores pticos. A parte do
lado direito do amplificador isolador alimentada pela mesma fonte que alimenta a UCP.
O circuito eletrnico do amplificador deve ser alimentado por fonte auxiliar e isolada de
24VCC.
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FONTE
E
13 / 84
Carto de 16
entradas
Sensor
14 / 84
CLP
SD - CC
SD - CC
+24V
+24V
CPU
CPU
carga
Fonte
auxiliar
24VCC
FONTE
S
FONTE
carga
0V
0V
10b SD - negativa
10a SD - positiva
D
Fonte
auxiliar
24VCC
SD - CA
CPU
S
Rede CA
110/220V
FONTE
carga
SD - rel
CPU
fonte CA
ou CC
S
FONTE
rel
carga
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Carto de 16
sadas
Carga
Figura 14 Exemplo de acionamento do estado de uma sada digital em funo do estado da memria
da rea especfica imagem das sadas de um CLP.
A figura 15 ilustra um trecho do manual dos cartes de sada digital da srie do CLP
SLC500 da Rockwell Automation.
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CLP
Amplificador
e atuador
Sensor
proporcional
Carto A/D
Figura 16 - Ilustrativo de um CLP sendo tambm empregado em um controle de malha
empregando um carto (AD) ou (EA) e um carto (DA) ou (SA).
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2.3.6 UCP
A Unidade Central de Processamento a unidade que executa o programa de
controle. Os CLPs tradicionais possuem uma UCP que realiza todas as funes de
controle, leitura e escrita na memria. Tambm existem atualmente CLPs que possuem
duas ou mais UPCs operando com diviso de tarefas. A figura 18 ilustra o diagrama de
bloco genrico de uma UCP.
Unidade programao
rea Local de Trabalho
UCP
Fonte
Programa
Usurio
MEMRIA SUPORTADA
POR BATERIA
EPROM / FLASH
Sistema Operacional
Start do CLP
Seqncia de Oper.
Drivers
Sinais de
Microprocessador
Controle
DISPOSITIVOS DE
COMUNICAO
Programa usurio
Configurao de dados
Buffer de Comunicao
MDULO LOCAL E/S
MDULO EXTENDIDO
E/S
ESTAES REMOTAS E/S
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a) Ciclo elementar
( entradasprogramasadas).
b) Ciclo de entradas agrupadas, sadas distribudas)
(entradasprocessamentosadasprocessamento de sadas).
c) Ciclo distribudo
(E/S ativadas conforme requisitadas) (EPOIP.......)
d) Ciclo distribudo com sub clock .
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SCAN DE
PROGRAMA
SCAN DE
ENTRADAS
SCAN DE SADA
20 / 84
B1
B1
A1
B2
B1
A1
A1
B1
B2
B1
B2
B3
B1
B3
B2
B3
O-S1
B2
B1
I-E1
O-S1
B3
B2
B1
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10
|--------------------------------------(
15
)------------|
02
O exemplo ilustrado na figura 22 significa que o registro nmero (endereo) 50, bit
15, se for levado para condio 1 (verdadeiro) acionar a bobina representada pelo
registro nmero (endereo) 10, bit 02. Portanto, ao olhar para o nmero do Ponto, o
usurio pode determinar o registrador que contm tal dado e o respectivo bit dentro
daquele registrador. Caso seja desejado registrar valores de temporizaes, contagens,
valores estatsticos, etc., ao invs de campos de bits (bit maps) tais registradores podero
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ser considerados, por exemplo nos sistemas de 16 bits, como variveis inteiras de 16 bits,
podendo armazenar valores entre -32768 a +32768.
Exemplo: suponha que um circuito eltrico tradicional esteja comandando a partida
de um motor trifsico. A figura 23 representa um circuito eltrico de comando de
acionamento desse motor.
Esse circuito emprega:
a) uma botoeira normalmente fechada;
b) uma botoeira normalmente aberta;
c) um contator para acionar o motor trifsico;
d) um contato auxiliar (normalmente aberto) do contator.
PB partida
PB parada
Contator_motor
Contator_motor
Neste caso, o diagrama ladder poder ser como ilustrado na figura 24.
I:1
I:1
00
01
O:2
00
O:2
00
Observa-se que a
fotografia apresenta um rack contendo uma fonte ( esquerda), diversos cartes e dois
CAP instalados no mesmo rack. Na figura, cada CAP pode ser identificado pela chave
presente em seu painel frontal, que permite escolher o modo de operao de cada
controlador (comentado adiante no documento). Este modelo tambm permite que os dois
CAPs distintos acessem todos os cartes de entrada instalados em um mesmo rack
comum.
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A arquitetura deste modelo difere das arquiteturas dos outro modelos de CLPs da
Rockwell Automation. Nesta arquitetura existem pelo menos duas UCPs: a denominada
UCP Logix e a UCP de backplane. Backplane a placa onde tanto os CAPs, CLPs e
cartes de Entrada/Sada e de comunicao so conectados. para o controlador
mostrado, a backplane a placa traseira do rack.
A UCP Logix executa os aplicativos e programas, alm de enviar as mensagens nos
barramentos de comunicao, conforme a necessidade.
A UCP de backplane se comunica com os cartes de entrada e sada, e opera de
forma independente da UCP do Logix.
Esta arquitetura permite uma maior versatilidade de operao, uma vez que as duas
UCPs operam de forma assncrona e independente. A figura 26 ilustra a macro arquitetura
das memrias de lgica/dados. De entradas/sadas e as duas UCPs.
Memria de Entradas/Sadas
UCP
Logix
Dado de entradas/Sadas
UCP
Backplane
Buffers de mensagem
...
Tags Produtor/Consumidor
Dados comuns
SCAN de
Programas
SCAN de
E/S
Conexes
um enlace entre dois
dispositivos. Estes dispositivos
podem ser controladores,
mdulos de comunicao,
mdulos de E/S, variveis
produzidas e consumidas ou
mensagens. O ContrlLogix
suporta at 250 conexes.
Compartilhamento de E/S
Os cartes de E/S do
ControlLogix podem ser
compartilhados de trs formas.
Funes bsicas do
controlador
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Posio RUN: Esta posio habilita o CLP no modo de operao (Run). O CLP
varre/executa as tarefas do programa, monitora dispositivos de entrada,
energiza dispositivos de sada e ativa pontos forados de E/S habilitados. O
modo do CLP pode ser alterado somente por meio de uma chave seletora
posicionada no painel frontal do mdulo da UCP Logix. No possvel
desenvolver a edio do programa online.
II.
III.
Posio REM: Esta posio habilita o CLP no modo remoto (Remote), quando
podem ser designados remotamente os modos de operao REMote Run,
REMote Program ou REMote Test. Tais modos de operao podem ser
alterados por meio da posio da chave seletora ou atravs da interface de
programao/operao. possvel desenvolver a edio de programa online
nessa condio.
Projeto
Tarefas
(Tasks)
Programa
Rotinas
Tarefa
1
2
3
4
Tipo de Tarefa
Peridica de 10 ms
Peridica de 20 ms
Contnua
Evento
Nvel de prioridade
5
10
nenhum
Mxima ou
configurvel
Tempo de
Execuo
2 ms
4 ms
24 ms
Quando o evento
ocorrer
30 / 84
Tarefa 1
Tarefa 2
Tarefa 3
Tarefa 4
5
10
15
20
25
30
35
40
45
50 ms
Legenda
Tarefa executada.
Tarefa interrompida.
Ocorrncia de um evento para a tarefa 4.
Figura 29 - Exemplo de execuo de tarefas em funo do tipo e da prioridade.
Projeto Mquina
de Empacotamento
Tarefa Principal
Contnua
Programa de Controle
Programa de Servo
Programa de Temp.
Tarefa de registro
Event-base
Programa de Registro
Rotina 1
Rotina 1
Rotina 1
Rotina 1
Rotina 2
Rotina 2
Rotina 2
Rotina 2
Rotina 3
Rotina 3
Em um projeto com um CLX existem quatro tipos de TAGs: Base, Alias, Produced e
Consumed. A tabela 4 ilustra esses tipos de TAGs.
Tabela 4 - Tipos de TAGs no CLX.
Tipo de TAG
Base
Alias
Produced
Consumed
Uma Base TAG armazena qualquer tipo de dado para ser empregado na lgica do
projeto, tais como: bit, inteiro, etc. A tabela 5 ilustra os tipos de Base TAGs e os
respectivos empregos para cada tipo. A tabela 6 ilustra os bits empregados no
armazenamento dos valores para cada tipo de Base TAG.
Tabela 5 - Tipos de Base TAGs e os respectivos empregos para cada tipo.
Tipo de TAG
BOOL
BOOL
CONTROL
COUNTER
DINT
INT
SINT
REAL
TIMER
Emprego
Bit
Pontos de entrada e sada (E/S) digitais
Sequenciadores
Contadores
Inteiros longos (com 32 bits)
Dispositivos analgicos em modo inteiro (Taxa de varredura
rpida)
Inteiro curto (8 bits)
Numeros com ponto flutuante
Temporizadores
Tabela 6 Exemplo dos bits empregados no armazenamento dos valores para cada tipo de Base
TAG.
Tipo de TAG
BOOL
SINT
INT
DINT
REAL
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Uma TAG tipo Alias usada para criar um nome alternativo, ou seja um apelido
para uma TAG j existente e j nomeada. Um Alias um smbolo para um endereo
especfico de entrada ou sada. Esse nome pode representar uma entrada ou sada do
mundo real, ou seja, a entrada ou sada de um dispositivo de campo. Um Alias tambm
pode ser interpretado como uma TAG indexada nela mesma, ou seja, ele est linkado
ou relacionado a TAG base. Assim, qualquer ao na TAG base tambm acontece com o
Alias e vice e versa. A figura 31 ilustra um exemplo em linguagem Ladder de nomes Alias
associados aos seus endereos reais.
Alias:
Sensor_1
Fan_Motor
<Local:1I:Data.2>
<Local:2O. Data.5>
|---------------|
|--------------------------------------(
)------------|
O endereamento das entradas e sadas E/S no CLX difere dos outros CLPs. As
informaes de E/S so apresentadas como um conjunto de TAGs. Cada TAG pode usar
uma estrutura de dados particular. A estrutura depende das caractersticas especficas de
cada mdulo de E/S. O nome da cada TAG baseado na localizao do mdulo de E/S
no sistema. A figura 32 ilustra parte deste processo.
Location
Slot
Type
Member
SubMember
...
Bit
Optional
Figura 32 - Ilustrativo parcial do endereamento das E/S, como visto na rvore de configurao do
projeto no software de parametrizao do ControlLogix.
34 / 84
Where
Location
Is
Network location.
LOCAL = same chassis or DIN rail as the controller
ADAPTER_NAME = identifies remote comm. adapter or bridge module
Slot
Slot number of I/O module in its chassis or DIN rail
Type
Type of data: I = input
O = output C = configuration S = status
Member
Specific data from the I/O module. Depends on what type of data the
module can store.
For a digital module, a Data member usually stores the input or
output bit values.
For an analog module, a Channel member (CH#) usually stores the
data for a channel.
SubMember Specific data related to a Member.
Bit
Specific point on a digital I/O module; depends on the size of the I/O
module (031 for a 32-point module).
Projeto
TAGS do
controlador
(dados globais)
Outras Rotinas
Dados de E/S
Sistema de diviso de dados
TAGs de programa
(dados locais)
para cada programa
Rotina Principal
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Programa B
Programa A
TAGs de
programa
(dados locais)
TAGs de
programa
(dados locais)
Outras Rotinas
Rotina Principal
Tag_4
Tag_5
Outras Rotinas
Rotina Principal
Tag_4
Tag_5
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Como resultado das atividades desse grupo, em 1993, foi publicada a primeira
verso da norma IEC 61131 sobre controladores programveis (CPs). A norma consiste
em 8 partes, inter-relacionadas, abordando aspectos especficos do tema.
Como mostrado na Tabela 8, os 5 principais tpicos da IEC 61131 abordam:
informaes e conceitos gerais; requisitos e testes para os equipamentos; linguagens de
programao de CPs, diretrizes de usurio, e mensagens e comunicaes. As demais
partes abordam: as diretrizes para implementao das linguagens de programao,
detalhes sobre programao com protocolos de comunicao de cho de fabrica (como o
FieldBus) e detalhes para implementao de controle com lgica Fuzzy.
Tabela 8 - Escopo das partes principais da norma IEC 61131-3.
Parte
1
2
Ttulo
Informaes gerais
Requisitos e testes para
equipamentos
Linguagens de programao
Guia do usurio
Especificaes de servios de
mensagens e comunicaes
Descrio
Definies e conceitos bsicos
Construo eltrica e mecnica
testes de verificao
Estrutura de software, linguagens e
execuo de programas
Guia de seleo, manuteno e
instalao. Padres de projeto.
Facilidades de software etc.
#E1
#E0
(Inic)
(Para)
#M1
#M1
#M2
#M1
#S2
(alarme)
#M1
#M2
#S1
#M1
#M2
#E2
(E)
(FCE)
#S1
#M2
(E)
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N do Bit
Estado do BIT
0
1
Instruo XIC
Falsa
Verdadeira
Endereo
N do Bit
Estado do BIT
0
1
Instruo XIO
Verdadeira
Falsa
No do Bit
seja colocado no valor lgico 1, o mesmo somente ser desabilitado caso uma instruo
OTU endereada para o mesmo endereo do Bit da instruo OTL seja acionada. Em
outras palavras a instruo OTL opera como um selo de um circuito de rel ou como um
flip-flop do tipo Set-Reset (a instruo OTL faz o SET e a instruo OTU faz o RESET). A
figura 39 ilustra a instruo OTL na linguagem LD.
Endereo
L
No. do Bit
Endereo
U
No do Bit
O bit EN colocado no estado lgico 1 cada vez que a instruo acionada. O bit
DN colocado no estado lgico 1 quando o valor do registrador acumulado (valor
ACCUM) for igual ao valor do registrador pr-selecionado (valor PRESET). A instruo
Temporizador crescente sem reteno ocupa trs palavras da memria do programa do
usurio. A figura 41 ilustra a instruo TON na linguagem LD.
TON
TIMER ON
TIMER
TIMER BASE
PRESET
ACCU M
EN
DN
EN
DN
PRESET
ACCU M
LES
LESS THAN ( A<B)
Source A
0<
I:3.0
Source B
568<
568
.....
46 / 84
Quando o valor Source A for menor que o valor Source B, esta instruo ser
logicamente verdadeira. Quando o valor Source A for maior ou igual ao valor Source B,
a instruo ser falsa.
b) Instruo Maior que GRT
A figura 44 apresenta o formato da instruo GRT.
GRT
GREATER THAN ( A>B)
Source A
0<
I:3.0
Source B
568<
568
.....
Quando o valor Source A for maior que o valor Source B, esta instruo ser
logicamente verdadeira. Quando o valor Source A for menor ou igual ao valor Source
B, a instruo ser falsa.
c) Instruo Testar Limite LIM
Esta instruo de entrada testa os valores dentro ou fora de uma faixa especificada,
dependendo de como foram ajustados os seus limites. A figura 45 mostra o formato da
instruo:
LIM
.....
LIMIT TEST
Low Limit
456<
Test
0<
High Limit
568<
456
I:3.1
568
47 / 84
Os parmetros para esta instruo Low Limit, Test e High Limit podem ser
constantes numricas ou endereos de palavras que armazenam algum valor, conforme a
tabela 9. A tabela 10 apresenta a funcionalidade da funo da instruo LIM.
Tabela 9 - Exemplo de instruo testar limite.
Test
Constante
Endereo de
palavra
High Limit
Endereo de palavra
Constante ou
Endereo de palavra
Low Limit
Endereo de palavra
Constante ou
Endereo de palavra
OSR
necessrio que se atribua um endereo para a instruo OSR, que deve ser um bit
reservado apenas para esta funo. O endereo utilizado no deve ser utilizado em
nenhum outro local do programa. Quando a condio da linha muda de falsa para
verdadeira a instruo OSR se torna verdadeira, tornando verdadeira a condio de linha
para a instruo de sada subsequente. Aps um ciclo de varredura do programa LD, a
instruo OSR se torna falsa, mesmo que as condies de linha sua esquerda sejam
verdadeiras. A instruo OSR apenas voltar a ser verdadeira quando houver,
novamente, uma transio de falso para verdadeiro nas condies de linha esquerda.
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INICIO
FORNO
PRONTO
PRONTO
VACUO
PRESSO
CHECKS
PRES_CH
a) Inicial
b) Normal
Quando um passo est ativo, o mesmo assinalado por meio de uma marca
token, ou por qualquer tipo de sinalizador que identifique o estado do passo. As
variveis associadas a um passo so:
Varivel FLAG, que indica que o passo est em atividade. Essa varivel tem
a nomenclatura (nome do passo).X.
Identificador
Nome do passo
Incio
Chave_inicio = 1
Encher
Reator_cheio = 1
Mover
Temporizador1.ET = T#1h
Drenar
Chave_inicio = 0
Fim
Figura 50 - Exemplo de um programa genrico simples para o controle de um reator em SFC.
Sequncia simples
ST
Trans
SB
Caminho divergente
ST
*
Trans 1
Trans 2
SB1
SB1
ST
*
2
1
Trans 1
Trans 2
SB1
SB1
Trans 1
Trans 2
SB1
SB1
Sequncia simultnea
ST
Trans
SB1
SB2
Convergncia de sequncia
ST2
ST1
Trans 1
Trans 2
SB
ST2
ST1
Trans
SB
52 / 84
Jump Condicional
E
2
E
Repetio Condicional
4...7
Sequncia Repetitiva
8
4...7
53 / 84
importante ressaltar que a condio de uma transio pode ser programada nas
linguagens da 61131-3 IL, ST, LD e FBD.
3.3.2 Aes em SFC
A linguagem SFC permite representar uma srie de aes bsicas. A estrutura tpica
: qualificador da ao, ao e indicador de varivel. A figura 51 apresenta a
representao grfica de dois passos e suas respectivas aes. A tabela 13 apresenta as
principais aes na linguagem SFC.
Operador_Aciona
Chave_Inicial
Abrir Vlvulas
Qualificador Descrio da ao
N
Ao simples. Executa a ao associada com o passo enquanto o
mesmo est ativo. No memoriza.
S
Set. Seta a ao ativa. Memoriza.
R
Reset. Reseta ou desativa a ao setada ou memorizada.
L
Ao por tempo limitado. Executa por um determinado tempo a
ao.
D
Ao de tempo retardado. Executa continuamente uma
determinada ao aps um retardo (atraso) de tempo.
P
Ao pulsada. Executa uma nica vez uma determinada ao.
SD
Ao de entrada com retardo prefixado.
SL
Ao setada com tempo limitado.
As figuras 52, 53, 54, 55, 56, 57, 58 ilustram exemplos de aes N, S, R, L, D, P e
SD, SL e os seus respectivos diagramas de tempo.
54 / 84
Ligar Motor M1
T1
Ligar M1
T1
Passo_1
Ligar motor M1
Passo_1.X
Ligar M1
T1
T1
T n-1
Tn-1
Passo N
Passo_N
Ligar motor M1
Tn
Tn
Passo_1
T1
Passo_1.X
Passo_1.X
Ligar M1
Ligar M1
3s
3s
T1
T1
55 / 84
Passo_1
T1
Passo_1.X
Passo_1.X
Ligar M1
3s
Ligar M1
3s
T1
T1
Figura 55 - Exemplo da Ao Tempo Retardado (D).
Passo_1.X
Passo 1
Ligar Motor M1
T1
Ligar M1
T1
Passo_1
SD
Ligar motor M1
T1
Tn-1
Passo_N
Tn
Passo_1.X
Ligar M1
Passo_1.X
3s
Ligar M1
T1
T1
T n-1
T n-1
Passo N
Passo N
Tn
3s
Tn
56 / 84
Tn-1
Passo_1
SL
Passo_N
T1
Ligar motor M1
Tn
Passo_1.X
Passo_1.X
Ligar M1
3s
Ligar M1
3s
T1
T1
T n-1
T n-1
Passo N
Passo N
Tn
Tn
Figura 58 - Exemplo da Ao com Tempo Limitado (SL).
Suponha que um sistema de refrigerao seja composto por dois motores, M1 e M2.
O motor M1 pode operar em duas velocidades: baixa (BV) e alta (AV). M1 opera em BV
quando a chave de partida acionada, e opera em AV quando um sensor de temperatura
digital for acionado. Caso o sensor de temperatura seja desligado, o motor dever operar
em BV. O motor M2 acionado pelo mesmo sensor de temperatura, caso um sensor de
umidade digital indique umidade acima do normal. O motor M2 deve ser desligado depois
de 60 minutos. A figura 59 apresenta o programa em SFC para executar o exemplo
exposto.
Incio
CP=1
N
2
M1_BV
Ligar motor M1
Em BV
ST=0 e (SU=0 ou T60 m)
ST=1 e SU=1
ST=1 e SU=0
ST=1 e (SU=0 ou T60 m)
3
M1_AV
Ligar motor M1 em
AV
4
M1_AV e M2
Ligar motor M1 em
AV e motor M2
CP=0
Fim
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Show or hide an
action.
Figura 60 - Ilustrativo de exemplo de trecho de programa escrito em SFC no CLX. (Fonte: Rockweel
Automation Logix5000 Controllers Sequential Function Charts Catalog Numbers 1756).
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Sobre_presso
TON
T#22
Alarme_1
OR
Habilitado
AND
Alarme_0
Assim como na linguagem LD, na linguagem FBD uma POU calculada de cima
para baixo. Uma rede em FBD, para ser executada, deve ter cada elemento funcional
calculado ou executado. Para cada elemento ser executado, esse deve ter todos os seus
parmetros de entrada definidos e ter todas as variveis de entradas prontas e j
calculadas, mesmo aquelas provenientes de outros blocos funcionais. O elemento ento
executado e suas sadas calculadas. O processamento da rede FBD no estar finalizado
enquanto todas as suas sadas no tiverem sido calculadas.
O grafo que conecta todas as entradas e sadas do FBD pode possuir loops, ou seja,
uma entrada pode estar associada a uma sada do mesmo grafo FBD. Nesse caso, o
fluxo de dados apresenta um carter sequencial, ou seja, a funo descrita depende de
seus parmetros usuais de entrada e tambm dos valores anteriores de suas prprias
sadas.
No caso especfico do CLX, praticamente todas as funes embutidas disponveis na
linguagem LD (timers, funes de lgica combinatria, funes aritmticas, etc.) tambm
esto disponveis como blocos funcionais ou funes para a linguagem FBD.
3.5 Linguagem ST
Texto estruturado (Structured Text) ou ST, como a linguagem IL, uma linguagem
de alto nvel, fortemente textualizada, e que no emprega operadores de baixo nvel como
aqueles encontrados em uma linguagem de mquina do tipo Assembly. A linguagem
oferece uma grande variedade de declaraes abstratas e construes simplificadas, que
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podem ser utilizadas em conjunto para descrever operaes mais complexas, atravs de
um processo algortmico.
A linguagem se assemelha a outras linguagens populares, como o ANSI C e,
principalmente, o PASCAL, da qual herda boa parte da semntica e dos elementos de
programao, por exemplo, cada linha de um programa escrito em ST apresenta uma ou
mais declaraes separadas por ; (sinalizador de trmino de linha). A linguagem ST
tambm permite que os programas sejam estruturados, identados e comentados,
conforme a necessidade. A tabela 14 ilustra as declaraes na linguagem ST.
Tabela 14 - Declaraes na linguagem ST (Karl and Michael Tiegelkamp)
Construo Descrio
Declarao,
:=
associao ou
atribuio
Chamada de
uma FB
RETURN
IF
Retorna
Seleo
CASE
Seleo
mltipla
FOR
Interao 1
WHILE
Interao 2
REPEAT
Interao 3
EXIT
;
//
Fim do loop
Declarao
Comentrio de
linha
Comentrio de
bloco
(*
*)
Exemplo
D := 10;
Explicao
Nome_FB;
Funcao1(10);
Temp:=Funcao2;
RETURN;
IF d<e THEN
f:=1;
ELSE d=e THEN
f:=2;
ELSE f:=3;
END IF;
CASE f OF
1: g:=11;
2: g:=12
ELSE
ND CASE;
FOR h:=1 TO 10
BY 2 DO
F[h/2]:=h;
END_FOR;
WHILE m>1 DO
N:=n/2;
END WHILE;
REPEAT
i:=i*10;
UNTIL i < 1000
END REPEAT;
EXIT;
; ;
//Algoritmo 2
(* Isso
um teste *)
Comentrios de cdigo
Terminaes prematuras.
Comentrios de cdigo
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SECCIONAMENTO
SECCIONAMENTO
PROTEO CONTRA
CURTO-CIRCUITO
PROTEO CONTRA
CURTO-CIRCUITO
PROTEO CONTRA
SOBRECARGA
PROTEO CONTRA
SOBRECARGA
COMUTAO
COMUTAO
INVERSOR DE
FREQNCIA
SOFT-START
MOTOR AC
MOTOR AC
CATEG.
AC1
TIPO DE CARGA
No indutiva (FP>0,9)
AC2
Motores em anis
(FP>0,65)
AC3
Motores de gaiola
(FP 0,45 para I<100A)
(FP 0,35 para I>100A)
AC4
Motores de gaiola
(FP 0,45 para I<100A)
(FP 0,35 para I>100A)
USO DO CONTATOR
Energizao
Partida
Desligar durante
operao
Frenagem
regenerativa
APLICAES TPICAS
Aquecimento, distribuio
Trefiladoras
Partida
Desligar durante
operao
Compressores, gruas,
misturadores, bombas,
escadas rolantes, ventiladores,
transportadoras, ar
condicionado
Partida
Desligar durante
operao
Frenagem
regenerativa
Inverso de
sentido de
rotao
Impressoras
Trefiladoras
COORDENAO
TIPO 2
COORDENAO
TOTAL
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Sensor de
proximidade
Fim de curso 1
Caamba
transportadora
Motor Trifsico de
Assncrono de induo.
Bobinas de 220 V AC.
Engrenagens
Circuito de
Potncia e
Proteo
PLC
Cartes de Entrada
e de Sada
Botoeiras
NA (partida)
NF (parada)
Alimentao
3 fases e neutro
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FASES
B
A1/A
A2/A
A3/A
BOBINAS
MOTOR
A1/C
A2/C
A1/B
A1/D
A2/B
A2/D
A3/B
A3/D
A3/C
Representa o
ponto comum
do mdulo de
sada.
VAC
VDC
A4/B
A4/A
A4/D
A4/C
Bobinas dos
contatores
FASE A
FASE B
Figura 66 - Ligao das bobinas com intertravamento de hardware por meio dos contatos auxiliares
dos contatores.
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sada
Endereo
Varivel
Tipo
entrada
Endereo
8
9
10
11
O:2/8
O:2/9
O:2/10
O:2/11
P.B. partida
P.B. parada
fim de curso 1
fim de curso 2
NA
NF
NA
NA
3
1
6
7
I:1/3
I:1/1
I:1/6
I:1/7
3
4
5
6
7
8
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Figura 68 - Diagrama LD com o CLP SLC 500 para implementar o algoritmo do processo.
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TC
TC
Circuito de
comando
HMI
IHM
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Rampa de acelerao da
tenso
100% de
Vn
Tempo de
subida Tp
Tempo
V(t)
Tp
Tempo
Figura 71 - Forma de onda da tenso aplicada no motor para que a tenso tenha a curva de
acelerao ilustrada na figura 70.
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Tempo de decida Td
Tempo
Td
Tempo
Figura 73 - Forma de onda da tenso aplicada no motor para que a tenso tenha a curva de
desacelerao ilustrada na figura 72.
L2 L3
FT1
Chave esttica
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REDE
Interface
serial
RS485
0 10 Volts
analgic
IHM
CPU
A
D
IGBTs
DIN
I/O
digital
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Figura 76 - Ilustrativo parcial dos circuitos e das respectivas formas de onda de tenso de um
inversor de frequncia.
Filtro no link CC
Inversor
Entrada CA
Sada CA
senoidal
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T1
T2
T3
T4
T1
T2
T3
T4
75 / 84
30
45
60
Hertz
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Esse tipo de controle apresenta melhorias se comparado com a tcnica V/Hz atravs
do provimento de ambos, magnitude e ngulo entre tenso e corrente, em vez do V/Hz
que controlava apenas a magnitude. O ngulo de tenso do motor controla a quantidade
de corrente que vai para o fluxo do motor, habilitado pelo estimador corrente de torque.
Por meio do controle desse ngulo, a operao em baixas velocidades e o controle de
torque substancialmente melhorado com relao ao V/Hz.
O controle vetorial fornece as seguintes vantagens em relao ao controle escalar:
a) Elevada preciso de regulao de velocidade;
b) Alta performance dinmica;
c) Controle de toque linear para aplicaes de posio ou de trao;
d) Operao suave em baixa velocidade e sem oscilaes de torque, mesmo
com variao de carga.
Os valores tpicos para esses inversores so:
a) Regulao de velocidade: 0,1%.
b) Regulao de torque: no tem.
c) Torque de partida: 250%.
d) Torque mximo (no contnuo): 250%.
e) Controle em malha aberta.
f) O inversor j conhece os parmetros da mquina pela auto-sintonia.
g) Possui melhor desempenho se comparado a um controle escalar (V/F).
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Nvel 1 Controle manual. Por exemplo, uma botoeira para acionar o motor
de uma ponte rolante; Sensores de temperatura, presso, nvel, umidade,
opacidade, PH, movimento; medidores de vazo etc.
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Nvel 3
Nvel 1
81 / 84
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6 Referncias Bibliogrficas
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Concepts and Programming Languages, Requirements for Programming Systems,
Decision-Making Aids Springer-Verlag Berlin Heidelberg 2010
STENERSON, J.; Programming ControLogix Programammble Automation Controllers
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FRANCHI, C.M. Acionamentos eltricos Editora rica Ltda 2008.
FRANCHI, C.M Inversores de frequncia. Teoria e aplicaes Editora rica Ltda 2008.
MOHAN, N.; UNDELAND, T.; RBBINS,W.P.; Power Eletronics John Wiley &Sons, Inc
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PEREIRA, S. L.; ANDRADE, A. A. Mdulo III Automao I: Controladores Programveis
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EPUSP 2008
MATAKAS, L. PEREIRA, S. L.;
Pontifcia
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