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Aunque no se ha dibujado, el sistema tendr un reset sncrono, activo a nivel bajo, que debe
hacer que el circuito comience a funcionar teniendo el display completamente apagado hasta
que se produzca la primera pulsacin. Se supondr que el reloj es lo suficientemente rpido
como para impedir que se pierdan pulsaciones (del orden de 1MHz). Tambin se supondr que
nunca se pulsan dos teclas a la vez, para simplificar el diseo.
Se pide:
1. Disear el generador de seales descrito.
2. Disear el sistema secuencial de almacenamiento y codificacin. Se sugiere dividir el
bloque en un primer subcircuito que almacene la tecla pulsada y un segundo
subcircuito que realice la decodificacin.
NOTA: se dispone nicamente de puertas lgicas, biestables, y multiplexores. Si se requiere
usar algn otro bloque, habr que dibujarlo o definirlo completamente.