Beruflich Dokumente
Kultur Dokumente
LABORATORIO N 5
CIRCUITOS ARITMETICOS
1.- Objetivo
Introducir al alumno en el diseo y aplicacin de circuitos aritmticos.
2.- Fundamento Terico
Por Irlenys Tersek
La forma mas simple de realizar una operacin aritmtica electrnicamente, es usando un
circuito llamado semi-sumado (Haft Adder). Este dispositivo permite que sean aplicados 2
bits de entradas (A,B) para producir dos salidas: uno correspondiente a resultado de la
suma (S) y la otra correspondiente a acarreo (C) segn se muestra en la tabla N1.
A B S C
0
Resta binaria
La resta o sustraccin de nmeros binarios es similar a los nmeros decimales. La
diferencia radica en que, en binario, cuando el minuendo es menor que el sustraendo, se
produce un prstamo o borrow de 2, mientras que en decimal se produce un prstamo de
10. Al igual que en la suma, el proceso de resta binaria, se inicia en la columna
correspondiente a la de los dgitos menos significativos. En la figura se indican las reglas
que rigen la resta binaria y se muestra un circuito lgico, llamado semirrestador (HS), que
sustrae un B de un bit A y suministra un bit de diferencia (Di) y un bit de prstamo (Bo).
Semirrestador
Ejemplo:
Suponga entradas a un sumador como el siguiente:
A4A3A2A1=01112 (716)
B4B3B2B1=10102 (A16)
CO=1
En este caso, la suma de los tres datos de entrada, 0111 + 1010 + 1 resulta ser igual 18.
De acuerdo a las reglas anteriores, se produce un bit de acarreo igual 1 y las salidas
adoptan un valor de 2 (esto es, 18 menos 16). Por lo tanto, C4 = 1 y 4 3 2 1=0010.
Sumadores en cascada
Es posible implementar sumadores para palabras de tamao superiores a 4 bits si se
disponen varios 74LS283 en cascada. Para el efecto, basta simplemente con conectar la
salida C4 del sumador de menor peso a la entrada CO del sumador siguente. En la figura
N 3 se muestra como se conectaran dos 74LS283 en cascada para conformar un
sumador de 8 bits. Los dos sumadores se muestran recibiendo como datos a dos
nmeros binarios de 8 bits cada uno cuyos valores son: A=11001010, B = 11100111,
CO=0. El resultado de la operacin, mostrado tambin en la misma figura es 10110001 y
C4= 1.+
3. Practica en Laboratorio.
a) Disear , simular e implementar un sumador paralelo de 4 bits y desplegar el
resultado en display.
b) Disear , simular e implementar un restador paralelo de 4 bits, con complemento
a 2 y desplegar el resultado en display.
c) Con el circuito integrado 74LS283 implementar un sumador de 4 bits y desplegar
el resultado en display.
d) Con el circuito integrado 74LS283 implementar un restador de 4 bits y desplegar
el resultado en display.