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Contedo:
1. motivao
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1. motivao
3. fotodeteco
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Aplicaes
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Exemplos cmeras semicondutoras - Silcio
cmos p/ celular e palm (0.3 a 1.5Mpx) pill cam, 256x256 px, 2fps, 8bits
Webcam
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Fluxo
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1. motivao
3. fotodeteco
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materiais
dispositivos
circuitos
sala limpa
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sala limpa (clean room)
Pr-filtragem
Ar externo
(micro-)eletrnica
Sistema de condicionamento de Ar.
Controle de umidade e temperatura.
semicondutores
Filtros
ptica e fotnica
Absolutos
(HEPA)
biotecnologia
Exausto
medicina
Filtro
Filtro
Ambiente com alto grau de controle ambiental: nvel de partculas, temperatura, umidade
Controle feito pela recirculao e introduo constante de ar altamente filtrado e condicionado.
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Si (silcio)
tipos de arranjo:
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Substrato
Silcio (Si):
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Densidade de chips
88 chips
Wafer 200-mm
232 chips
Wafer 300-mm
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Bandas de energia
Semicondutor Dieltrico
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Bandas de energia Si e GaAS
Eg (Si) = 1.12eV
Eg (GaAs) = 1.45eV
Si e GaAs cristalinos
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Efeito trmico
Semicondutor intrnseco
(= no dopado)
temperatura , ni
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Dopagem do Si (silcio) tipo-n e tipo-p
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1. motivao
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Espectro ptico
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Espectro visvel
litografia
corona termografia
E = h.f = h.c/
f, frequncia (Hz)
h, constante de Planck (6.626 x 10-34 J s)
Eazul = 2.6 eV
c, velocidade da luz (3 x 108 m/s)
Everde = 2.3 eV
, comprimento de onda (m)
Everm = 1.9 eV
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Espectro solar (II) AM 1.5
UV infravermelho
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GaAs
Si
Ge
InGaAs
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Unidades Fotomtricas/ Radiomtricas mais relevantes (I)
Iluminncia: lux
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Unidades Fotomtricas/ Radiomtricas (II)
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Fotodiodo juno p-n
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Mecanismo de fotodeteco Juno PN
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Eficincia Quntica () e Responsividade ( R )
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Parmetros da juno (I)
Espessura da juno: Wd
2 Si N A + N D
Wd = (bi + Vb )
e N AN D NA , dopagem da regio p
ND , dopagem da regio n
bi , potencial embutido
Vb , tenso reversa aplicada
mat , constante dieltrica = K material 0
K Si = 11.9, 0= 8.85 x 10
-12 As/Vm (ou 10-14 F/cm)
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Curva I-V de um fotodiodo
e
n , fator de idealidade ( 1 n 2 )
i = i0 e 1 i p
V Dx, difusividade portad. majoritrios = (kT/e)x
n . kT
Lx, compr. difuso de portadores minoritrios
Nx, nvel de dopagem (tomos/cm3)
Dp Dn
i0 = e A n 2
i +
L p N D Ln N A
rea juno
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Capacitor MOS
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luz incidente
balde de
sinal
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Capacitor MOS - elemento CCD bsico
Si
Si
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Capacitor MOS - modo de acumulao
+ + +
+ +
+ buracos
eltrons gerados termicamente
VG < 0
acmulo de portadores majoritrios na interface Si/SiO2
na superfcie pp> NA = dopagem do substrato
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Capacitor MOS - modo de depleo
+ + - - -+ - - - - - +
+ ++ + + + + -+ - - - -
+ buracos
- ons negativos fixos na rede
VT > VG > 0
ausncia de portadores majoritrios na regio de depleo
ons fixos negativos na regio de depleo
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Capacitor MOS - modo de depleo VG2 > VG1
+ + + +
+ +
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Capacitor MOS - modo de inverso
+ + + +
VG VT > 0
VT, tenso limiar (threshold voltage)
ocorre se houver um nmero suficiente de eltrons gerados termicamente
eltrons (originalmente minoritrios) se acumulam na interface
largura W max atingida no ponto de inverso
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Capacitor MOS - modo de inverso
VG > VT > 0
VT, tenso limiar (threshold voltage)
s ocorre se houver um nmero suficiente de
eltrons gerados termicamente ou fotogerados
eltrons (minoritrios) se agrupam na interface
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Capacitor
MOS
Sensor de CCD
Imagem
Capacitor
MOS
modificado
Silcio Processo de
Fabricao
Fotodiodo
CMOS Fotoporta
Quntico
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1. motivao
3. fotodeteco
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Transporte de carga
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Prof. Albert Theuwissen
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Transporte de carga - chaveamento
Credits: http://harvestimaging.com
Prof. Albert Theuwissen
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CCD - 3 fases
fases
pxel 1 pxel 2
(portas/gates)
tempo
imagem incidindo
nos pxeis
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CCD 2D full-frame (FF)
Full-Frame CCD
ausncia da rea de armazenamento
necessidade de shutter (obturador)
Credits: http://harvestimaging.com
Prof. Albert Theuwissen
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CCD 2D frame-transfer (FT)
Credits: http://harvestimaging.com
Prof. Albert Theuwissen
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CCD 2D interline-transfer (IL)
Credits: http://harvestimaging.com
Prof. Albert Theuwissen
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CCD 2D frame-interline-transfer (FIT)
Credits: http://harvestimaging.com
Prof. Albert Theuwissen
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CCD 2D frame-transfer (FT)
160m
rea de armazenamento
Barramento
Amplificador
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1. motivao
3. fotodeteco
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microeletrnica processo CMOS
Receita com vrios ingredientes (materiais) e etapas subsequentes para produo de
circuitos integrados em uma lmina (wafer)
dreno fonte
dieltrico
Transistor MOS(FET)
substrato - Si
semicondutor
MOSFET-N MOSFET-P
(eltrons) (lacunas/buracos)
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1. tecnologia madura e em constante evoluo
2. processo mais utilizado hoje na indstria de semicondutores/eletrnica
3. processo +/- genrico
4. dezenas a centenas de milhes de transistores lgicos / cm2
5. baixa tenso / baixo consumo de energia
6. NMOS e PMOS
7. funcionalidade digital
8. funcionalidade analgica
9. modelos de dispositivos e de processos confiveis
10. ferramentas de simulao e de processamento atualizadas
11. taxa razoavelmente alta de sucesso na fabricao: rendimento (yield)
12. interesse de mercado: investimentos macios
13. disponibilidade de foundries e de processos multichips/multi-usurios (MWP)
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processo CMOS Lmina (Wafer) 450mm
pizza de silcio
lingote de silcio
(Processo Czochralski)
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Leitura de sinal
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Conceitos de
eletrnica integrada
(microeletrnica)
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Transistor MOSFET tipo NMOS
S D
B
p+ substrato original Silcio dopado
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Transistor MOSFET tipo NMOS
Jaeger - p. 9 Fig. 1.6f dreno dreno
fonte fonte
contatos
contatos
porta trilhas metal
porta
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Transistor MOSFET tipo PMOS
porta (gate)
G
p+ p+
++ --
S D
G n - camada epitaxial
S D
B n+ substrato original
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Chip com NMOS e PMOS: CMOS (MOS complementar)
camadas empilhadas
de metal e xido
NMOS PMOS
porta porta
fonte dreno fonte dreno
n+ n+ p+ L p+
L
poo n (n-well)
Substrato Si monocristalino
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metal
dreno/fonte
VCC poo n (Si dopado n) (Si dopado p)
HI porta metal
M1 LOW M1
(Si policristalino)
input output
input output
LOW M2 HI
substrato
(Si monocristalino) M2
Ground
dreno/fonte
(Si dopado n)
metal
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Pxel Passivo (PPS)
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pxeis ativos CMOS - APS (3T: trs transistores)
OBJETIVO
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pxel ativo para cmera digital CMOS ( layout ) VLSI: Very-Large-Scale Integration
FOTODIODO
reset/M1
pulso reset
sinal fotodiodo
select/M3
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cmera digital
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sensor ptico de posio CMOS
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AMS Austria MicroSystems XFAB
CEITEC
CMP
TSMC
Onde fabricar? MOSIS
UMC ST-Microelectronics
AMIS
ON Semiconductors
Tower-Jazz Semiconductors
Europractice
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Escolher da tecnologia CMOS (rtulo), ex.: 0,35m
1 Escolher da empresa de fabricao (foundry) CMOS
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Concluses
Microeletrnica / circuitos integrados estratgico
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