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de un Microcontrolador.
Microcontroladores.
Distribucin de terminales.
El PIC 18F4550 tiene las siguientes caractersticas en lo que se
refiere a las terminales.
40 terminales en un encapsulado PDIP.
44 terminales en un encapsulado TQFP o QFN.
13 32 30
OSC1/CLKI/RA7
Cristal oscilador o entrada externa de reloj.
OSC1 I ST
Entrada de cristal oscilador o entrada de fuente externa de reloj.
Buffer ST cuando esta configurado en modo RC; anlogo en otra configuracin.
Fuente externa de entrada de reloj. Siempre asociada con la funcin de terminal
CLKI I CMOS
OSC1.
RA5/AN4//HLVDIN/ 7 24 24
C2OUT
RA5 I/O TTL E/S digital.
AN4 I Analgico Entrada analgica 4.
I TTL Entrada de seleccin de modo esclavo SPI.
HLVDIN I Analgico Entrada de deteccin de voltaje ALTO/BAJO.
C2OUT O - Salida del comparador 2.
33 9 8
RB0/INT0/FLT0/AN12
/SDI/SDA
I/O TTL E/S digital.
RB0
I Analgico Interrupcin externa 0.
INT0
I ST Entrada de fallo en PWM del modulo ECCP1
FLT0
I ST Entrada analgica 12.
AN12
I ST Entrada de datos del modulo SPI.
SDI
I/O ST E/S de datos del IC.
SDA
34 10 9
RB1/INT1/AN10/SCK/
SCL
I/O TTL E/S digital.
RB1
I Analgico Interrupcin externa 1.
INT1
I ST Entrada analgica 10.
AN10
I/O ST Seal de reloj serial sncrona E/S para el modo SPI.
SCK
I/O ST Seal de reloj serial sncrona E/S para el modo IC.
SCL
35 11 10
RB2/INT2/AN8/VMO
RB2
I/O TTL E/S digital.
INT2
I Analgico Interrupcin externa 2.
AN8
I ST Entrada analgica 8.
VMO
O - Salida del transceptor externo USB.
Distribucin
Nombre de la Numero de de
terminal terminales
Tipo de Tipo de
(Puerto B).
Descripcin
terminal terminal Buffer
PDIP QFN TQFP
RB4/KBI0/AN11/CSS 37 14 14
PP
RB4 I/O TTL E/S digital.
KBI0 I TTL Terminal de interrupcin al cambio.
AN11 I Analgico Entrada analgica 11.
CSSPP O - Salida SSP de control de seleccin de chip.
RB5/KBI1/PGM 38 15 15
RB5 I/O TTL E/S digital.
KBI1 I TTL Terminal de interrupcin al cambio.
PGM I ST Terminal de habilitacin para Programacin ICSP a bajo voltaje.
RB6/KBI2/PGC 39 16 16
RB6 I/O TTL E/S digital.
KBI2 I TTL Terminal de interrupcin al cambio.
PGC I ST Terminal de seal de reloj para Programacin ICSP e ICD.
Distribucin de terminales (Puerto B).
Nombre de la Numero de terminal Tipo de Tipo de
Descripcin
terminal terminal Buffer
PDIP QFN TQFP
RC0/T1OSO/T13CKI 15 34 32
RC0 I/O ST E/S digital.
T1OSO O - Salida del oscilador del Timer1.
T13CKI I ST Entrada de reloj externa para el Timer1/TImer3.
RC1/T1OSI/CCP2/UOE 16 35 35
RC1 I/O ST E/S digital.
T1OSI I CMOS Entrada del oscilador del Timer1.
CCP2 I/O ST Entrada de captura 2/Salida de comparador 2/Salida PWM 2. *Salida alternativa
cuando es borrado el bit de configuracin CCP2MX.
UOE O - Salida OE del transceptor externo USB.
RC2/CCP1/P1A 17 36 36
RC2 I/O ST E/S digital.
CCP1 I/O ST Entrada de captura 1/Salida de comparador 1/Salida PWM 1.
P1A O - Salida del ECCP1.
Distribucin de terminales (Puerto C).
Nombre de la Numero de terminal Tipo de Tipo de
Descripcin
terminal terminal Buffer
PDIP QFN TQFP
RC5/D+/VP 24 43 43
E/S digital.
RC5 I ST
(E/S) lnea diferencial positiva del USB
D+ I/O -
Entrada VP del transceptor USB externo.
VP I ST
RC6/TX/CK 25 44 44
E/S digital.
RC6 I/O ST
Transmisin de EUSART asncrona.
TX O -
Reloj de EUSART sncrona.
CK I/O ST
RC7/RX/DT/SDO 26 1 1
E/S digital.
RC7 I/O ST
Recepcin de EUSART asncrona.
RX I ST
Datos de EUSART sncrona.
DT I/O
Salida de datos de SPI.
SDO O
Distribucin de terminales (Puerto D).
Nombre de la Numero de terminal Tipo de Tipo de
Descripcin
terminal terminal Buffer
PDIP QFN TQFP
RD0/SPP0 19 38 38
RD0 I/O ST E/S digital.
SPP0 I/O TTL Datos del puerto paralelo esclavo.
RD1/SPP1 20 39 39
RD1 I/O ST E/S digital.
SPP1 I/O TTL Datos del puerto paralelo esclavo.
RD2/SPP2 21 40 40
RD2 I/O ST E/S digital.
SPP2 I/O TTL Datos del puerto paralelo esclavo.
RD3/SPP3 22 41 41
RD3 I/O ST E/S digital.
SPP3 I/O TTL Datos del puerto paralelo esclavo.
Distribucin de terminales (Puerto D).
Nombre de la Numero de terminal Tipo de Tipo de
Descripcin
terminal terminal Buffer
PDIP QFN TQFP
RD4/SPP4 27 2 2
RD4 I/O ST E/S digital.
SPP4 I/O TTL Datos del puerto paralelo esclavo.
RD5/SPP5/P1B 28 3 3
RC5 I/O ST E/S digital.
SPP5 I/O TTL Datos del puerto paralelo esclavo.
P1B O - Salida del ECCP 1.
RD6/PSP6/P1C 29 4 4
RC6 I/O ST E/S digital.
SPP6 I/O TTL Datos del puerto paralelo esclavo.
P1C O - Salida del ECCP 1.
RD7/SPP7/P1D 30 5 5
RC7 I/O ST E/S digital.
SPP7 I/O TTL Datos del puerto paralelo esclavo.
P1D O - Salida del ECCP 1.
Distribucin de terminales (Puerto E).
Nombre de la Numero de terminal Tipo de Tipo de
Descripcin
terminal PDIP QFN TQFP terminal Buffer
PORTE es un puerto E/S bidireccional.
RE0/CK1SSP/AN5 8 25 25
RE0 I/O ST E/S digital.
CK1SSP O - Salida de seal de reloj 1 del SSP
AN5 I Analgico Entrada analgica 5.
RE1/CK2SSP/AN6 9 26 26
RE1 I/O ST E/S digital.
CK2SSP O - Salida de seal de reloj 2 del SSP
AN6 I Analgico Entrada analgica 5.
RE2/OESSP/AN7 10 27 27
RE2 I/O ST E/S digital.
OESSP O - Salida de habilitacin para salida del SSP
AN7 I Analgico Entrada analgica 5.
6, 30,
VSS 12, 31 6, 29 P Referencia a tierra para la lgica y las terminales de E/S.
31
12, 13,
NC - 13 - No conectado.
33, 34
Osciladores.
El PIC 18F4550 dispone de doce opciones para el oscilador principal:
XT (Cristal/resonador).
HS (Cristal/resonador de alta velocidad).
HSPLL (Cristal/resonador de alta velocidad con PLL activado).
INTHS (Oscilador interno como fuente de seal de reloj para el MCU, oscilador HS usado
como fuente de reloj para el modulo USB).
INTIO (Oscilador interno como fuente de seal de reloj para el MCU, oscilador EC usado
como fuente de reloj para el modulo USB y E/S en RA6).
INTCKO (Oscilador interno como fuente de seal de reloj para el MCU, oscilador EC usado
como fuente de reloj para el modulo USB y salida Fosc/4 en RA6)
EC (Reloj externo con salida Fosc/4 en RA6).
ECIO (Reloj externo con E/S en RA6).
ECPLL (Reloj externo con PLL habilitado y salida Fosc/4 en RA6).
ECPIO (Reloj externo con PLL habilitado y E/S en RA6).
Osciladores.
Debido a las diversas opciones en cuanto al oscilador el PIC 18F4550 puede trabajar
a distintas frecuencias.
Ya que cuenta con un modulo para comunicacin USB el 18F4550 requiere de un
fuente de reloj especifica (6 o 48 MHz).
Al trabajar con altas frecuencias en el oscilador principal se tiene el siguiente
comportamiento:
Se reduce la duracin de los ciclos maquina con ellos el tiempo de ejecucin de las
instrucciones.
Aumenta el consumo de energa.
El chip permanecer en BOR hasta que el VDD aumente y sea mayor que el VBOR.
Brown-Out Reset (BOR).
El BOR y el Power-on Timer (PWRT) son configurados independientemente si se
habilita el BOR, no se habilita automticamente el PWRT.
Los eventos del BOR son capturados en el bit (RCON <0>).
El estado de este bit es puesto a cero cuando sea que ocurra un BOR.
Timers de Reset del dispositivo.
El PIC18F4550 incorpora tres temporizadores dentro del mismo chip que ayudan a
regular el proceso de Power-on Reset (Reset al encendider).
Su funcin principal es la de garantizar la estabilidad de la seal de reloj antes de
ejecutar el cdigo de programa.
Estos timers son:
Power-up Timer (PWRT).
Oscillator Start-up Timer (OST).
PLL Lock Time-Out.
Los modos de operaciones ofrecen una variedad de opciones para el ahorro de energa en
donde los recursos son limitados (Dispositivos alimentados por bateras).
Estas categoras define la porcin del microcontrolador que esta trabajando con una seal
de reloj y a veces la velocidad del dispositivo.
Modos de manejo de energa.
Los modos normales y de espera pueden usar uno de las tres fuentes de seal de reloj
disponibles (Oscilador primario, secundario o bloque interno).
Los modos de manejo de energa en los PIC 18 ofrecen varias funciones ya existentes en
otras familias de microcontroladores PIC:
El intercambio de la fuente de reloj, que le permite al microcontrolador usar el oscilador del Timer1 en
lugar del oscilador principal.