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LGICA [Ao]
SECUENCIAL. CONTADORES Y REGISTROS.
I.E.S. CAMAS.
Dpto: ELECTRICIDAD/ELECTRNICA.
Autor: Jess Gonzlez Ros.
CONTADORES
Contadores asncronos.
+5V
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TEMA: XX. ELECTRNICA DIGITAL. LGICA [Ao]
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Dpto: ELECTRICIDAD/ELECTRNICA.
Autor: Jess Gonzlez Ros.
J Q J Q
CK CK
Impulsos a K Q K Q
contar
R R
4K7
R QO Q1
Impulsos
a contar
0 1 0 1 0 1 0
Q0
0 0 1 1 0 0 1
Q1
E0 E1 E2 E3
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Autor: Jess Gonzlez Ros.
Clok Q1 Q0 Estados
--- 0 0 E0
0 1 E1
1 0 E2
1 1 E3
Figuras.- Contador asncrono mdulo 4. Cronograma. Tabla de verdad. (se utilizan biestables JK edge
triggered CI 74HC73).
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Contadores BCD.
Contador mdulo 6.
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Descontadores.
Cada circuito conmutador, compuesto por dos puertas NAND y una OR, se
comporta como un multiplexor de dos canales.
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Contadores sncronos.
Se conoce por circuito secuencial sncrono, aquel en que todos los elementos
de memoria comparten la misma seal de reloj. Por lo tanto en un contador
sncrono todos los biestables tienen una lnea de reloj comn.
2. Tabla de transicin.
Salvo para el primer biestable las entradas del resto dependen de los estados
de los biestables anteriores y a su vez la salida de estos influyen en las entradas
de los siguientes. Esto significa, que se estar memorizando un nuevo estado
mientras el actual est siendo ledo por otro elemento de memoria. Para evitar
problemas de temporizacin ser conveniente utilizar biestables con
sincronismo maestro-esclavo, ya que sigue manteniendo la salida hasta el
siguiente flanco activo de reloj; aunque se haya memorizado una entrada en el
nivel previo al flanco.
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Como se desprende del circuito anterior, entre dos impulsos de cuenta consecutivos el
tiempo mnimo que debe transcurrir es el de conmutacin de los biestables, ms el de
propagacin de las puertas AND, ms el tiempo de establecimiento (tset-up) de una
entrada en un biestable. De esta forma se asegura que las excitaciones en el instante
anterior se almacenan en los biestables, pasan por las puertas y estn presentes a la
entrada de los Flip-Flops el tiempo suficiente, antes de la llegada de un nuevo impulso
de reloj. Por lo tanto la frecuencia mxima de funcionamiento, que es independiente
del nmero de elementos de memoria del contador, tiene la siguiente expresin:
Para un contador de n bits la salida del biestable de menor peso (QA) se conecta a n-2
puertas AND. Las entradas de excitacin del biestable de mayor peso requieren una
puerta AND de n-1 entradas (caso de acarreo paralelo). Para valores elevados de n, la
capacidad de excitacin (fan-out) que debe presentar el elemento de memoria de
menor peso supone un requerimiento difcil de satisfacer, como tambin lo es la
implementacin de una puerta AND con gran nmero de entradas. Esta limitacin
tecnolgica se puede salvar utilizando contadores sncronos con acarreo serie. En los
contadores sncronos con acarreo serie la entrada a la puerta AND proviene de la salida
de la puerta AND anterior (de ah el nombre de acarreo serie).
QA QB JC= KC QC JD= KD QD
Figura.- Paralelo.
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QA QB JC= KC QC QD
Figura.- Serie.
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