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DSP 1 Gnralits
Oprateur
Interface H-M
Unit de contrle Systme embarqu
Logiciel
Mmoire Alimentations
Ports ROM RAM
E/S
Autres systmes
ENVIRONNEMENT EXTERNE
Courbe d'volution
du cot par rapport
la complexit:
A retenir:
si la fonction raliser est simple une logique cble
si le nombre d'units raliser est trs important circuits intgrs ddi
en logique cble pour les fonctions simples, sinon circuit programmables
Bus
Entres
Sorties
donnes)
Architecture des processeurs dusage gnral CPU
Goulot d'tranglement pour l'accs la
mmoire Bande passante
limite
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C
DSP 1 Gnralits
Mmoire
Van
Donnes
Neumann
CPU
Mmoire
Compatibilit
programme
Harvard Bus
MUX externes
Vitesse
Composants
logiques classiques DSPs
Microcontrleurs
Microprocesseurs
Spcialisation
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C
DSP 1 Gnralits
Couche ISA (Instruction Set Architecture):
Cest linterface entre le logiciel et le matriel
Cest le langage intermdiaire commun aux diffrents
langages de haut niveau
Programme
C Fortran
Compilation
Logiciel (Software)
Couche ISA
Matriel (Hardware)
Excution du programme ISA
par le matriel
Matriel
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C
DSP 1 Gnralits
Jeu dinstruction:
Ensemble des commandes primitives que le programmeur
peut utiliser sur une machine.
Microcontrleur
Entres
Sorties
Microcontrleur
Entres =
Microprocesseur + Mmoires + Ports
Sorties
intgrs dans le mme botier
Avantages
- Encombrement rduit Mmoire
- Circuit imprim peu
complexe
- Faible consommation
D
- Cot rduit P B
A
Inconvnients B
C
- Systme de dveloppement B
onreux
Circuits E/S
- Programmation ncessitant
un matriel adapt
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C
DSP 1 Microcontrleur
Description:
C.P.U. (MICROPROCESSEUR):
STOP
START
RXD RXD
PARIT
DE
UNIT UNIT
DE
BIT
BIT
TXD
MATRE ESCLAVE OU
RXD
TXD TXD D0 D1 D2 D3 D4 D5 D6 P
TRAMES t
ROM / EPROM /
E / S LOGIQUES
ANALOGIQUES
RFRENCE
FABRICANT
EEPROM
ENTRES
VITESSE
FLASH
TIMER
RAM
8051 Intel 12 Mhz 128 o 4 Ko X 32 2 0
16C71 Microchip 20 Mhz 36 o 1Kx14 X 13 1 4
6805 S2 Motorola 4 MHz 64 1 Ko X 16 2 8
68HC11 A1 Motorola 8 MHz 256 o X 512 22 1 8
AT90S 8515 Atmel 20 MHz 512 o 4 Ko 512 32 3 8
ST 6265 Thomson 8 MHz 128 o 4 Ko 64 o 21 2 13
Le microcontrleur 68HC11
MC68HC11E0 512 - - -
A B Accumulateurs A et B : 8 bits
D Accumulateurs D (A:B) : 16 bits
Le registre Y :
Il joue le mme rle que X si ce n'est que
toute instruction utilisant Y plutt que X se
code sur un octet supplmentaire donc son
excution est alors plus lente.
PC
Le registre PC (Program Counter) :
Ce registre appel compteur ordinal contient
l'adresse de la prochaine instruction du
programme qui sera excute.
Il permet donc au C de grer la squence des
instructions du programme, en particulier lors
des boucles.
Il est incrment automatiquement par la taille
de linstruction.
S X H I N Z V C
Carry
Stop Disable
Overflow
X-Interrupt Mask
Zero
Half Carry
Negative
I-Interrupt Mask
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C
DSP 1 Microcontrleur: 68HC11
Le registre CCR:
Signle Chip: fonctionnement autonome, tous les ports sont disponibles par
contre la mmoire est limite la mmoire interne.
Adressage Inhrent:
Adressage Immdiat: #
LDAA #$4F
ADDA #127
LDX #$0100
Adressage Etendu:
LDAA $1000
STAA $1001
Adressage Direct:
LDAA $00
STAA $FF
Adressage Index:
LDX #$1000
CLR 0,X
LDAA $FF,X
Adressage Relatif:
BRA suite
..
..
suite . (-128 < offset < 127)
Arithmtiques:
ABA, ADCA/B, ADDA/B, ADDD, ANDA/B, CBA,
CLRA/B/M, CMPA/B, COMA/B/M, CPD, DAA,
DECA/B/M, EORA/B, FDIV, INCA/B/M, MUL,
NEGA/B/M, ORAA/B, SBA, SBCA/B, SUBA/B, SUBD,
TSTA/B/M
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C
DSP 1 Microcontrleur: 68HC11
Dcalage-rotation
Branchement-contrle:
BCC, BCS, BEQ, BGE, BGT, BHI, BHS, BLE, BLO, BLS,
BLT, BMI, BNE, BPL, BVC, BVS, BRA, BSR, BRCLR,
BRSET, JMP, JSR, RTI, RTS, STOP, SWI, WAI
Oprations CCR:
CLC/I/V, SEC/I/V
Port A:
Le port A est un port parallle usage gnral
partag avec le TIMER et laccumulateur
dimpulsions
RESET 0 0 0 0 0 0 0 0
$1000 DDRA7 PAEN PAMOD PEDGE DDRA3 I4/05 RTR1 RTR0
RESET 0 0 0 0 0 0 0 0
$1004 PB7 PB6 PB5 PB4 PB3 PB2 PB1 PB0
ADDR1 ADDR1 ADDR1 ADDR1 ADDR11 ADDR1 ADDR9 ADDR8
5 4 3 2 0
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C
DSP 1 Microcontrleur: 68HC11
Port C:
RESET I I I I I I I I
$100 3 PC7 PC6 PC5 PC4 PC3 PC2 PC1 PC0
Exp/test ADDR ADDR ADDR ADDR ADDR ADDR ADDR ADDR
7 6 5 4 3 2 1 0
DATA7 DATA6 DATA5 DATA4 DATA3 DATA2 DATA1 DATA0
RESET - - I I I I I I
$100 8 0 0 PD5 PD4 PD3 PD2 PD1 PD0
- - PD5 PD4 PD3 PD2 PD1 PD0
/SS SCK MOSI MISO TX RX
D
RESET I I I I I I I I
$100 A PE7 PE6 PE5 PE4 PE3 PE2 PE1 PE0
AN7 AN6 AN5 AN4 AN3 AN2 AN1 AN0
E