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1. Objetivos
2. Fundamentos tericos: Conocer los principios de funcionamiento de los circuitos PLL, sus
frmulas prcticas las curvas de funcionamiento y otros que permiten definir los parmetros
de diseo de un PLL, Conocer sus aplicaciones en sistemas de control y de
telecomunicaciones.
Tanto la salida del comparador de fase como la del VCO, son digitales, o sea, slo pueden tomar
los valores "0" (0 voltios) "1" (tensin de alimentacin).
Cuando estos tres dispositivos se empalman para trabajar como un PLL, actan de la siguiente
forma:
Funcin de transferencia
Si ahora introducimos una seal de frecuencia fi mayor que la fo mnima, la salida del
comparador pasar a "1", y el condensador del filtro se ir cargando y la frecuencia del VCO
(fo) ir aumentando, evolucionando el sistema hacia el punto B.
Este proceso seguir hasta que fo>f1. En este momento la salida del comparador pasa a "0", con
lo que el condensador empieza a descargarse a travs de R. Pero en cuanto baja la tensin Vd que
se aplica al VCO, fo tambin baja, pasando de nuevo a que fo sea menor que f1 y por tanto a que
la salida del comparador pase de nuevo a sacar un1aumentando de nuevo la frecuencia del VCO.
Desde este momento, si no se cambia la frecuencia de entrada, el sistema permanecer oscilando
alrededor del punto B.
Cuando el PLL ha llegado a este estado se dice que est en "lock" (enganchado). A partir de este
punto la frecuencia de salida del VCO seguir a la de entrada, siempre que sta no salga del margen
(fmn - fmx).
"Rango de captura" (fc) es el rango de frecuencia de la seal de entrada sobre las que el PLL
engancha, si inicialmente estaba fuera de los mrgenes.
Para todo PLL en general, el rango de captura es < que el rango de enganche. En nuestro PLL,
debido a las caractersticas internas del comparador de fase, la frecuencia de captura y de enganche
son las mismas
Hay que hacer notar que siempre que el PLL est enganchado, en la salida del filtro habr la
tensin correspondiente a la frecuencia de entrada, segn la funcin inversa de la figura 6. (Tensin
en funcin de la frecuencia)
La figura 7 muestra el diagrama de bloques del Cos/Mos. CD 4046A el cual ha sido realizado en
un solo c.i. monoltico.
La estructura de bloques del PLL consta de:
Un oscilador lineal de bajo consumo controlado por voltaje (VCO)
Dos comparadores de fase diferentes y teniendo un amplificador de entrada comn.
El VCO se puede conectar, bien directamente o bien a travs de unos divisores, a la entrada
de los comparadores de fase.
El filtro paso bajo, teniendo en cuenta que ciertos componentes no son integrables y que la
configuracin cambia de una aplicacin a otra, hay que realizarlo mediante componentes externos
COMPARADORES DE FASE
En este punto estable ambos transistores estn al corte, y la seal a la salida de la pata uno ("Phase
pulses") es "1", indicando una condicin de " enganchado . As, para el comparador de fase II no
existe diferencia de fase entre la seal de entrada y la salida de VCO en todo el rango de frecuencias
del VCO.
Hay que hacer notar que para este tipo de comparador el rango de frecuencias de " lock " abarca todo
el rango de frecuencias del oscilador.
OSCILADOR CONTROLADO POR VOLTAJE (VCO).
La figura 9. Muestra el diagrama esquemtico del VCO. Para asegurar el bajo consumo (70 w) es
deseable que el filtro paso bajo consuma poco. Por ejemplo, en un filtro RC, esta condicin
requiere utilizar un alto valor de R y un pequeo valor de C. (Por esta misma razn todas las
resistencias exteriores son mayores de 10 K)
La entrada del VCO tampoco debe cargar o modificar las caractersticas del filtro paso bajos. Por
esto en el diseo se utiliza un MOSFET, canal n en la configuracin de entrada, presentando una
impedancia de entrada casi infinita, y por tanto un elevado grado de libertad en la eleccin de
los componentes del filtro.
Con el fin de no cargar el filtro paso-bajo est prevista una salida por seguidor de emisor de la
entrada del VCO (salida de demodulacin fig.7). Si se usa esta salida, debe conectarse una
resistencia, Rs, de 10 K o ms, desde el terminal 10 a masa. Si no se usa este terminal
permanecer abierto. (Nosotros no lo utilizamos) Un cero en la entrada de inhibicin permite
actuar el VCO y el seguidor de fuente, mientras un uno lgico desconecta ambos y minimiza
la potencia de consumo al mnimo estndar.
3. Clculos:
D atos : 1 1
R2 R2
Fm in 1 K H z Fm ax * C 1 1 00 K H z* 680 pF
Fm ax 100 K H z R 2 1.4 M
C 1 680 pF
1 1
R1 R2
( Fm ax Fm in ) * C 1 (10 0 K H z 1 K H z ) * 680 pF
R1 14.8 K
1 1
Fc 2 * FL * FPB Fc 2 *49.5KHz*380KHz
2 2
Fc 54.72KHz
4. Procedimiento en laboratorio:
SEAL SENOIDAL
SEAL CUADRADA
5. Materiales y Equipos:
a) Osciloscopio
b) Generador de frecuencias
c) Modulos que permitan disear un PLL
d) Fuente de tensin variable
e) Componentes electrnicos (resistencias, capacitores, cables de
conexin)
6. Conclusin:
Se pudo demostrar que un PLL u oscilador enganchado en fase tiene
diversas aplicaciones y que la ms usada es como un multiplicador de
frecuencia.
7. Bibliografa:
Apuntes obtenidos en clase
https://tomrospa.wordpress.com/2013/07/08/el-pll-analogico-y-su-
simulacion-y-iv/
www.a-ten.com/alz/ecd.htm. Atlantis Enterprises. Amplia referencia bibliogrfica