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Escuela de Ing Eléctrica
Universidad de El Salvador
20 exámen'Programables'101 3.

1) 45% Escriba un programa con modelo de memoria 'small', para un 8086, y para
masm 6.0 en adelante, que identifica todos los #s impares de un dígito, de un
máximo de--99_*s introducidos por medio de la función OAH de la interrupción 21H.
Asuma pantalla limpia y el cursor en fila cero, columna cero al inicio. El programa al
ejecutarse muestra primero, en la posición actual del cursor, el mensaje'introduzca
los números:l. Después de introducir los números se procede a identificar los #s
impares ubicados en el buffer de la función OAH. Use direccionamiento relativo a Sl
para leer en AL cada # del buffer y la instrucción TEST para probar si es par o
impar. Si es impar se guarda en la tablal!_UMEROS ( accese la tabla con BX) y se
incrementa la variable-_qu.'EllllA(lleva el total de #s impares) que inicialmente es
cero. Haga dicha prueba con un loop. Después debe mostrarse el mensaje'jljqtal
de #s impares es de :' (con un retorno de carro y avance de línea antes) y a
continuación el total. Para esto, si el total en AX es < 10 la conversión a ASCII es
directa y se muestra en la posición actual del cursor con la función 6 de la int 21H.
Si es > 10 usar la instrucción AAM antes. Por último se muestra el mensaje: 'dichos
#s son:' (con un retorno de carro y avance de línea antes) y a continuación se
mueetran lcs dígit';s e¡i ia iabia i\iU¡,4EROS con la función 6 de la int 21H. iJse un
loop y direccionamiento relativo a Sl para accesar los #s. Todos los mensajes se
muestran con la función 9 de la int 21H.
2) 4OYo a) Obtenga la lógica decodificadora, solamente con compuertas, para 128Kb
de memoria ram con chips de 16kb en un sistema 80486, para el rango de
direcciones desde q00_00009H a 990-IFFFFH. Indique en el circuito las salidas
abilitadoras de escritura del circuito or abilitador y los rangos de direcciones. b)
Basado en el circuito que genera 8 estados de espera ( fig 9-17 del libro) en un
sistema 8086 con señales síncronas, si el registro de desplazamiento activado por la
elevación de clk es de 2 bits, traze el diagrama de tiempo para 2 estados de espera
en un cíclo de lectura. Incluya las señales CLK, RDYI,/RD, READY y las salidas
Qa y Qb del circuito, considerando que RDYI se activa durante T1 . /RD se activa
durante T2 desactivándose durante T4.
3) 15Yo a) Indique el significado,de x y de las Y en el sistema de identificación
DDRx-YYYY para ios chips de memoria ram de la pc, y el de las zzz en el sistema
de identificación PCx-zzz parc los módulos de memoria. b) Obtenga el ancho de
banda para un módulo de memoria con chips ram DDR2-1066. c) Con relación al
voltaje de operación y a la potencia de consumo, brevemente mencione la diferencia
entre chips DDR3, DDR2 y DDR. d) Para un módulo de memoria defina la latencia
CAS.
¿Que tecnología DDR tiene la menor latencia ? e) Brevemente explique lo que
permite a los chips DDR3 operar a frecuencias de reloj mayores que los chips DDR2
y a estos a mayor frecuencia que los chips DDR.

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