TECNOLÓGICO NACIONAL DE MEXICO

INSTITUTO TECNOLÓGICO DE LÁZARO CÁRDENAS

Academia de Ingeniería Electrónica

Instituto Tecnológico de Lázaro Cárdenas

Ingeniería Electrónica

Prácticas No.13

“CIRCUITO DE AMARRE DE FASE (PLL)”

Nombres de los alumnos:

-López Rivera Roberto Carlos

-García Robledo Samuel
-Téllez Sagrero Alexis Emanuel

Nombre del profesor: Ing. Félix Gómez Sánchez

Fecha de realización: 4/Diciembre/2017

Calificación: ____________
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CARRERA PLAN DE CLAVE DE NOMBRE DE LA

ESTUDIO LA ASIGNATURA
ASIGNAURA
Ingeniería Escolarizado ETF-1002 Amplificadores Operacionales
Electrónica
PRACTICA LABORATORIO DURACIÓN
No. DE: EN HORAS:
13 Electrónica 2

1.OBJETIVO O COMPETENCIA

1.- Ajustar la frecuencia central de un PLL, observar el intervalo de enganche, medir la

frecuencia de captura máxima y mínima y medir el voltaje de cd a partir de la salida de
FM.

2.FUNDAMENTOS
El circuito PLL (Phase Locked-Loop) es un sistema retroalimentado cuyo objetivo
principal consiste en la generación de una señal de salida con amplitud fija y
frecuencia coincidente con la de entrada, dentro de un margen determinado.
Comprende tres etapas fundamentales:

Figura 1. Diagrama a bloques del PLL.

LAZOS DE AMARRE DE FASE (PLL).

Los componentes básicos de un PLL son:
1.- El detector de fase (PD, siglas en ingles)
2.- EL filtro pasa-bajas (LPF, siglas en ingles)
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3.- EL oscilador de controlado por voltaje (VCO, siglas en ingles)

Figura 3. Clasificación de PLL

LAZOS DE AMARRE DE FASE

• Un detector de fase es un mezclador optimizado para usarse con frecuencias de
entrada iguales. Éste se denomina detector de fase (o comparador de fase) dado que
la cantidad de voltaje de cd depende del ángulo de fase ϕ entre las señales de
entrada. A medida que el ángulo de fase cambia lo mismo ocurre con el voltaje de cd.
• La Figura ilustra el ángulo de fase entre dos señales senoidales. Cuando estas
señales excitan al detector de fase de la Figura 4-b), como salida se obtiene un voltaje
de cd. Un tipo de detector de fase tiene un voltaje de salida que varía como muestra
la Figura 4-c). Cuando el ángulo de fase ϕ es 0, el voltaje de cd es máximo. A medida
que el ángulo de fase se incrementa de 0 a 180°, el voltaje de cd decrece a su valor
mínimo. Cuando ϕ es 90°, la salida de cd es el promedio entre las salidas máxima y
mínima.
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Figura 4. Graficas de PLL

LAZOS DE AMARRE DE FASE (PLL) CONT.

• En relación con cualquier VCO es importante recordar que un voltaje de cd de

entrada controla la frecuencia de salida. Un incremento en el voltaje de control de cd
ocasiona que la frecuencia del VCO disminuya.
• Cuando el voltaje de cd en la Figura 5-a) se incrementa, la frecuencia de la señal de
salida de crece. En otras palabras, un voltaje de cd controla la frecuencia del
oscilador.
• Típicamente, la frecuencia decrece en forma lineal con un incremento en el voltaje
de cd (Figura 5-b).

Figura 5-a Entrada de VCO

Figura 6-c. Lazos del circuito de amarre de fase.

Una señal de entrada con frecuencia de fx es una de las entradas al detector de fase.
La otra entrada viene de un VCO. La salida del detector de fase se filtra a través de
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un filtro pasobajas. Este remueve las frecuencias originales, sus armónicas y

frecuencia suma. Solo la frecuencia diferencia (voltaje de cd) sale del filtro paso bajas.
Este voltaje de cd entonces controla la frecuencia del VCO.
El sistema realimentado engancha la frecuencia del VCO a la frecuencia de la
entrada. Cuando el sistema trabaja de manera correcta, la frecuencia del VCO es
igual a fx, la misma que la de la señal de entrada. Por lo tanto, el detector de fase
tiene dos entradas con frecuencias iguales; el ángulo de fase de estas entradas
determina la cantidad de voltaje de cd de salida. La Figura 6-b) muestra los fasores
para la señal de entrada y la del VCO.
Si la frecuencia de entrada cambia, la frecuencia del VCO la seguirá. Por ejemplo, si
la frecuencia de entrada fx se incrementa ligeramente, su fasor girará más rápido y el
ángulo de fase aumenta como se muestra en la Figura 6-c).
Esto significa que saldrá menos voltaje de cd en la salida del detector de fase. El
voltaje de cd más bajo forzará a que la frecuencia del VCO se incremente hasta que
se iguale a fx.
Por otro lado, si la frecuencia de entrada decrece, su fasor disminuye su velocidad de
giro y el ángulo de fase decrece como se muestra en la Figura 6-d). Ahora se tendrá
más voltaje de cd a la salida del detector de fase, lo cual causa que la frecuencia del
VCO disminuya hasta que se iguala a la frecuencia de entrada. Es decir, el PLL
corrige de manera automática la frecuencia del VCO y el ángulo de fase.

El intervalo de enganche, BL, es el intervalo de frecuencias que el VCO puede

producir, y está dado por
𝐵𝐿 = 𝑓𝑚𝑎𝑥 − 𝑓𝑚𝑖𝑛
Una vez que el PLL está enganchado, la frecuencia de entrada, fx, puede variar
desde 40 hasta 60 kHz, el VCO seguirá esta frecuencia de entrada y la salida
enganchada será igual a fx.
Modo de funcionamiento libre.
Recuerde el temporizador 555 conectado como astable sin voltaje de control. Este
oscilará a una frecuencia natural determinada por las componentes del circuito. Lo
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mismo es cierto para el VCO de la Figura 6-a). Si la señal de entrada se desconecta,

el VCO oscila en modo de funcionamiento libre a una frecuencia que determinan las
componentes del circuito.
Captura y enganche.
Suponga que el PLL está en funcionamiento libre o desenganchado. El PLL se puede
enganchar a la frecuencia de entrada si ésta cae dentro del intervalo de captura, una
banda de frecuencias centradas alrededor de la frecuencia de funcionamiento libre. La
fórmula para el intervalo de captura es
𝐵𝐶 = 𝑓2 − 𝑓1
Donde f1 y f2 son las frecuencias más alta y más baja en las que el PLL se puede
enganchar. El intervalo de captura siempre es menor o igual al intervalo de enganche
y está relacionado con la frecuencia de corte del filtro pasobajas.
Mientras la frecuencia de corte es más baja, el intervalo de captura es más pequeño.
PLL con el ci 565
• Un resistor de temporización externo se conecta a la terminal 8 y el capacitor de
temporización externo a la terminal 9. Estos dos componentes determinan la
frecuencia de funcionamiento libre del VCO.

Figura 7. Diagrama circuito interno 565

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Figura 8. Formulas del Circuito 565.

3. MATERIAL Y EQUIPO NECESARIO

 * Fuente de alimentación: fuente de alimentación de 15 Vcd.

 * Equipo: Osciloscopio digital, generador de audio, contador electrónico, Multímetro
digital.
 * Resistores: dos de 1 kΩ, uno de 4.7 a ½ W.
 * Potenciómetro: uno de 5 kΩ.
 * Circuito integrado: LM 565.
 * Capacitores: uno de 0.01 µF, uno de 0.047 µF, dos de 0.1 µF, uno de 1µF.
 Otros: Protoboard y alambre para conexiones.

4. DESARROLLO DE LA PRÁCTICA
Metodología.
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+9 V

4.7kΩ

5k
50%

10 8
4
2 Salida enganchada
5
1uF 1kΩ 565

7
3 Salida de FM

9 1
1kΩ CT CF
10nF

-9 V

Diagrama de conexión

Frecuencia de funcionamiento libre.

1. 1. Se procedio a armar el circuito de la Figura anterior.
2. Si el generador de la señal de ca de la Figura 16-6 se desconecta, el 565 está en
operación de funcionamiento libre. ¿Cuál es la frecuencia del VCO si el cursor del
potenciómetro está en la parte superior? Registre las frecuencias calculadas en la
Tabla 16-1.
3.
4. 2. Conecte el circuito de la Figura 16-6 con un CF de 0.2 µF (use dos capacitores de
0.1 µF en paralelo).
5.
6. 3. Desconecte de manera temporal el generador de señal de ca para obtener la
operación de funcionamiento libre.
7.
8. 4. Observe con un osciloscopio la salida del VCO (terminal 4). Use una sensibilidad
vertical de 5 V/cm y una base de tiempo de 0.1 ms/cm. Varíe el potenciómetro y
observe como cambia la frecuencia.
9.
10. 5. Mida la frecuencia máxima y mínima de funcionamiento libre. Registre las
frecuencias medidas en la Tabla 16-1.
11.
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12. 6. Ajuste el potenciómetro para obtener una frecuencia central de unos 5 kHz.

Tabla 16-1. Mediciones del PLL en funcionamiento libre

Cursor fcalc, kHz. fmedida, kHz.

Arriba 6.38 kHz 5.11 kHz

Abajo 3.09 kHz 2.97 kHz

.3 .3
𝑓𝑠𝑢𝑝𝑒𝑟𝑖𝑜𝑟 = = = 𝟔. 𝟑𝟖𝑲𝑯𝒁
𝑅𝑇𝐶𝑇 (4.7𝐾Ω)(10𝜂𝐹)
.3 .3
𝑓𝑖𝑛𝑓𝑒𝑟𝑖𝑜𝑟 = = = 𝟑. 𝟎𝟗𝑲𝑯𝒁
𝑅𝑇𝐶𝑇 (9.7𝐾Ω)(10𝜂𝐹)

Intervalo de enganche.
13. 7. Reconecte el generador de señal de ca. Observe la señal en la terminal 2. Ajuste el
generador para obtener 0.5 V pp a 5 kHz.
14.
15. 8. Observe la salida (terminal 4). Varíe la frecuencia del generador de 4 a 6 khz.
Observe como la salida del PLL se engancha con la señal de entrada.
16.
17. 9. Mida las frecuencias de enganche máxima y mínima. Registre estos valores en la
Tabla 16-2.

Tabla 16-2. Mediciones del PLL en intervalo de enganche.

fmáx, kHz. fmín, kHz.

6.8kHz 3.6kHz

Intervalo de captura.
18.
19. 10. Calcule las frecuencias de corte del filtro pasbajas para los valores de CF en la
Tabla 16-3. Anote los resultados.
20. 11. Mida y anote en la Tabla 16-3 las frecuencias de captura máxima y mínima.
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Calcule y registre el intervalo de captura, BC.

21. 12. Repita el paso 11 para los demás valores de CF en la Tabla 16-3.

Tabla 16-3. Mediciones del PLL en intervalo de captura.

CF, µF fcorte, kHz. fmáx, kHz. fmín, kHz. BC, kHz

0.2 221.04 HZ 6.43 KHZ 3.05 KHZ 3.38 KHZ

0.1 442.1 HZ 6.62 KHZ 3.2 KHZ 3.42 KHZ

0.047 940.63 HZ 6.63 KHZ 3.13 KHZ 3.5 KHZ

1 1
𝑓𝑐1 = = = 𝟐𝟐𝟏. 𝟎𝟒 𝑯𝒁
2𝜋𝑅𝐹𝐶𝐹 2𝜋(3.6𝐾Ω)(. 2𝜇𝐹)
1 1
𝑓𝑐2 = = = 𝟒𝟒𝟐. 𝟏 𝑯𝒁
2𝜋𝑅𝐹𝐶𝐹 2𝜋(3.6𝐾Ω)(. 1𝜇𝐹)
1 1
𝑓𝑐1 = = = 𝟗𝟒𝟎. 𝟔𝟑 𝑯𝒁
2𝜋𝑅𝐹𝐶𝐹 2𝜋(3.6𝐾Ω)(. 047𝜇𝐹)

Salida de FM.
22.
23. 13. Mida el voltaje de cd (con multímetro digital si es posible) en la salida de FM
(terminal 7) para una frecuencia de entrada de 4 kHz. Registre el voltaje de cd en la
Tabla 16-4.

Tabla 16-4. Mediciones del PLL, salida de FM

Frecuencia, kHz. Vcd, V

4 7.72 V

5 7.36 V

6 6.93V
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LECTURAS EN EL OSCILOSCOPIO

Cuestionario.
1.- ¿Cuál es el intervalo de captura para CF = 0?2 µF?

.3 .3
𝑓𝑜 = = = 3.09𝐾𝐻𝑍
𝑅𝑇𝐶𝑇 (9.7𝑘Ω)(10𝜂𝐹)
8𝑓𝑜 8(3.09𝐾𝐻𝑍)
𝑓𝐿 = ± = = 1.03 𝐾𝐻𝑍
𝑣𝑐𝑐 24𝑣
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1 2𝜋𝑓𝐿 1 2𝜋(1.03𝐾𝐻𝑍)
𝑓𝐶 = √ = √ = 𝟒𝟕𝟕. 𝟏𝟓 𝑯𝒁
2𝜋 𝑅2 𝐶2 2𝜋 (3.6𝐾Ω)(.2𝜇𝐹)

2.- ¿cuál es el efecto del capacitor del filtro en el intervalo de captura?

Aumenta el capacitor aumenta la frecuencia y por ende aumenta el ancho de banda

3.- Los datos de la Tabla 16-4 prueban que un PLL puede producir una salida de FM demodulada.
Explique por qué.
Se debe a que el PLL produce un voltaje proporcional a la frecuencia de la señal entrante la que, en
el caso de FM, es la señal moduladora original.

4.- ¿Qué cambio haría para obtener una frecuencia de funcionamiento libre de 50 kHz?
Cambiar los valores de las resistencias (RT) y del capacitor (CT).

5. RESULTADOS Y CONCLUSIONES

Conclusiones

Al finalizar la práctica se pudo observar en las lecturas del osciloscopio lo visto en la

teoría, cuando se conectó una frecuencia de 4 KHz, el valor del voltaje medido fue
mayor valor que cuando se conectó una frecuencia de 6 KHz, comprobando que a
mayor frecuencia, menor voltaje de CD.

6. BIBLIOGRAFIA Y ANEXOS

Amplificadores operacionales y circuitos integrados lineales. Robert F.

Coughlin, Frederick F. Driscoll.