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CIRCUITOS
FLIP FLOPs
4. FLIP FLOPS........................................................................................................1
4.1 INTRODUÇÃO....................................................................................................1
....................................................................................................1
4.2 FLIP-FLOP R-S (RESET–SET)...........................................................................2
...........................................................................2
4.3 FLIP-FLOPS COM CLOCK....................................................................................4
....................................................................................4
4.4 FLIP-FLOP R-S COM CLOCK..............................................................................5
..............................................................................5
4.5 FLIP-FLOP J-K................................................................................................
J-K................................................................................................6
6
4.6 FLIP-FLOP T ("TOGGLE")...............................................................................
")...............................................................................6
6
4.7 FLIP-FLOP D...................................................................................................
D...................................................................................................7
7
4.8 LATCH D........................................................................................................
D........................................................................................................7
7
4.9 ENTRADAS ASSÍNCRONAS....................................................................................8
....................................................................................8
4.10 TEMPORIZAÇÕES DOS FLIP-FLOPS.....................................................................9
.....................................................................9
TEMPO DE AJUSTE (SETUP) E CONSERVAÇÃO (HOLD)..........................................................9
ATRASOS DE PROPAGAÇÃO ......................................................................................10
FREQÜÊNCIA MÁXIMA DE CLOCK (FMAX) ..................................................................10
TEMPOS DE DURAÇÃO DO CLOCK EM ALTO E BAIXO ................................................11
LARGURA DOS PULSOS ASSÍNCRONOS ..........................................................................11
TEMPOS DE TRANSIÇÃO DO CLOCK ..............................................................................11
CIRCUITOS COMERCIAIS............................................................................................11
4.11 CIRCUITOS COMERCIAIS SÉRIE SN74XX........................................................
SN74XX........................................................13
13
4.12 EXERCÍCIOS.................................................................................................16
.................................................................................................16
4.13 REFERÊNCIAS BIBLIOGRÁFICAS.......................................................................28
.......................................................................28
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
4. FLIP FLOPS
4 .1 Introdução
Por outro lado, entende-se por circuitos seqüenciais àqueles cuja saída
em um determinado instante de tempo não depende apenas das entra-
das naquele instante de tempo, mas também das entradas anteriores e
da seqüência como elas foram aplicadas. A maioria dos sistemas digitais
é composta tanto por circuitos combinacionais como de elementos de
memória. Os circuitos de memória mais utilizados em circuitos seqüen-
ciais tratam-se dos Flip-Flops e os circuitos "LATCH" são dispositivo bies-
tável (possuem dois estados estáveis (0,1)). Eles permanecem em um
destes dois estados até ocorra algum evento que o faça assumir o outro
estado estável. O fato do flip-flop manter uma informação ao longo do
tempo o caracteriza como um dispositivo de memória.
V . 20 02 P ág . 1
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S
Q
R Q
V . 20 04 -2 2
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Caso Q0 Q0 S R Q Q
1 0 1 0 0 0 1
1 0 0 0 1 0
2 0 1 0 1 0 1
1 0 0 1 0 1
3 0 1 1 0 1 0
1 0 1 0 1 0
4 0 1 1 1 1* 1*
1 0 1 1 1* 1*
S R Q Q
0 0 Q0 Q0
1 0 1 0
0 1 0 1
1 1 * *
V . 20 04 -2 3
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V . 20 04 -2 4
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S R Clk Q Q
X X 0 Q0 Q0
0 0 ↑ Q0 Q0
1 0 ↑ 1 0
0 1 ↑ 0 1
1 1 ↑ * *
S R Clk Q Q
X X 0 Q0 Q0
0 0 ↓ Q0 Q0
1 0 ↓ 1 0
0 1 ↓ 0 1
1 1 ↓ * *
V . 20 04 -2 5
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4 .5 Flip-Flop J-K
J K Clk Q Q
X X 0 Q0 Q0
0 0 ↑ Q0 Q0
1 0 ↑ 1 0
0 1 ↑ 0 1
1 1 ↑ Q0 Q0
4 .6 Flip-Flop T ("Toggle")
V . 20 04 -2 6
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4 .7 Flip-Flop D
S (J)
R (K)
D Clk Q Q
X 0 Q0 Q0
0 ↑ 0 1
1 ↑ 1 0
4 .8 Latch D
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EN D Q Q
0 X Q0 Q0
1 0 0 1
1 1 1 0
4 .9 Entradas assíncronas
V . 20 04 -2 8
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Tabela 4-2
PRE CLR Q Q
1 1 operação normal
0 1 1 0
1 0 0 1
0 0 * *
Fig. 4.15 flip-flop J-K com entradas assíncronas - simbologia e tabela verdade
Os tempos de setup (ts ) e hold (th ) são parâmetros que devem ser ob-
servados para que o flip-flop possa trabalhar de modo confiável. O tem-
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Atrasos de Propagação
É a freqüência mais alta que pode ser aplicada na qual o flip-flop funcio-
na de modo confiável.
V . 20 04 -2 10
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Circuitos comerciais
V . 20 04 -2 11
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ts 20 20 60 25 ns
th 5 0 0 0 ns
tpHL (de CLK para Q)
40 24 200 31 ns
tpLH (de CLK para Q)
25 16 200 31 ns
tpHL (de CLR ou PRE para Q) 40 24 225 41 ns
tpLH (de CLR ou PRE para Q) 25 16 225 41 ns
twH (CLK)
37 15 100 25 ns
twL (CLK)
30 20 100 25 ns
fMAX
15 30 5 20 MHz
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V . 20 04 -2 13
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V . 20 04 -2 14
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V . 20 04 -2 15
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4 .1 2 Exercícios
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V . 20 04 -2 17
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A J Pr Q A J Pr Q A Pr Q
J
clk clk clk
A J Pr Q A J Pr Q A J Pr Q
clk clk clk
Clk
Pr
Clr
FFa
FFd
FFc
FFd
FFe
FFf
V . 20 04 -2 18
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A S Q
Clk
B
R CLR Q
Clk
Clr
A J Q
En
B Q
K
Clk
V . 20 04 -2 19
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DADO J PR Q
Clk
K CLR Q
Clk
Clr
PR
DADO
DADO
D PR Q
Clk
CLR Q
Clk
Clr
PR
DADO
V . 20 04 -2 20
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11) Faça o diagrama de tempo do circuito abaixo, para as saídas Q1, Q2, e entrada D
DADO
J1 Q1 J2 Q2
Clk
K1 Q1 K2 Q2
Q1 Q1
Clk
V . 20 04 -2 21
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12) Para cada Flip-Flop ou LATCH tipo SR, faça o diagrama de tempo para as saídas indi-
cadas.
A S Q
B R Q
a) Considere inicialmente Q = 0.
A
A S Q
C En
B R Q
b) Considere inicialmente Q = 1.
A
A S Q
C En
B R Q
c) Considere inicialmente Q = 1.
A
V . 20 04 -2 22
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
A S Q
C Clk
B R Q
d) Considere inicialmente Q = 0.
A
A S Q
C Clk
B R Q
e) Considere inicialmente Q = 1.
A
13) Para cada Flip-Flop ou LATCH tipo D, faça o diagrama de tempo para as saídas.
A D Q
C En
Q
a) Considere inicialmente Q = 0.
A
V . 20 04 -2 23
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
A D Q
C En
Q
b) Considere inicialmente Q = 1.
A
A D Q
C Clk
Q
c) Considere inicialmente Q = 0.
A D Q
C Clk
Q
d) Considere inicialmente Q = 1.
V . 20 04 -2 24
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14) Para cada FF tipo JK, faça o diagrama de tempo para as saídas Q e Q .
A J Q
C Clk
B K Q
a) Considere inicialmente Q = 1.
A
A J Q
C Clk
B K Q
b) Considere inicialmente Q = 0.
A
15) Para cada FF tipo T, faça o diagrama de tempo para as saídas solicitadas
A T Q
C Clk
Q
a) Considere inicialmente Q = 0.
V . 20 04 -2 25
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
A T Q
C Clk
Q
b) Considere inicialmente Q = 1.
Pr
A J Q
C Clk
B K Q
Clr
c) Considere inicialmente Q = 0.
V . 20 04 -2 26
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
16) Dado o FF JK do CI 74LS107 abaixo, complete o diagrama de tempo para a saída 1Q.
CLK
CLR
+5V
0V
DADO
Clk
CLR
DADO
17) Dado o FF JK do CI 74LS109 abaixo, complete o diagrama de tempo para a saída 1Q.
+5V
0V
DADO
CLR
CLK
PR
Clk
PR
CLR
DADO
V . 20 04 -2 27
CURS O DE EL E TR Ô N I C A DI G I T A L CE FE T/ S C
4 .1 3 Referências Bibliográficas
V . 20 04 -2 28