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-Pin 7 5[V]
̅̅̅̅ 𝒚 𝑹𝑫
𝑪𝑺 ̅̅̅̅̅ = 𝟎[𝑽]
̅̅̅̅̅
𝑾𝑹 𝟑[𝒗] → 𝟎[𝑽]
-Salida válida 600 [ns]
Después de
̅̅̅̅̅ 𝟎[𝒗] → 𝟓[𝑽]
𝑾𝑹
Twr+600[ns]=1200[ns]
TM: es el valor que tendrá antes de que empiecen lo que se debe hacer con el FPGA(Field
Programable Gate Array).
-El reloj empezará dos microsegundos después que el tiempo de muestreo este en bajo,
-TM=10[µs]
-fM=100[KHz]