UNIVERSIDAD NACIONAL MAYOR DE SAN

MARCOS UNIVERSIDAD DEL PERÚ, DECANA DE

AMERICA

Facultad de Ingeniería Electrónica y Eléctrica

INFORME FINAL N° 2

CURSO:

MICROELECTRÓNICA

PROFESOR:

DR. RUBEN ALARCON MATUTTI

ALUMNO:

Quispe Fierro Russell Oscar 15190126

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 1. Diseñar un sumador completo de 1 bit usando solamente puertas de paso. (use dos
transistores en paralelo, tipo N y tipo P).
DISEÑO DE LAYOUT DE UN SUMADOR COMPLETO DE 1 BIT

2. S
Ddfdsfdsds
SIMULACIÓN DEL DISEÑO DE LAYOUT:

CALCULO DE LA FRECUENCIA MAXIMA DE OPERACIÓN:

𝑻𝑺𝒖𝒃𝒊𝒅𝒂𝟏 = 𝟏𝟓𝟒 𝒑𝒔

𝑻𝑺𝒖𝒃𝒊𝒅𝒂𝟐 = 𝟔𝟗 𝒑𝒔

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 Procedemos a calcular la frecuencia máxima de operación con el valor de la frecuencia de subida dada a
que es la mayor frecuencia.
𝟏
𝒇𝑴𝒂𝒙.𝑶𝒑𝒆𝒓𝒂𝒄𝒊𝒐𝒏 = =6.5 GHz
𝑻𝑺𝒖𝒃𝒊𝒅𝒂

3. Diseñar la función dada usando el estilo CMOS estático:

𝒀 = (𝑨 + 𝑩)(𝑨 + 𝑪 + 𝑬)(𝑨 + 𝑫)
Layout a full custom:

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 Simulación:

1 1
𝐹𝑟𝑒𝑐𝑢𝑒𝑛𝑐𝑖𝑎 𝑚á𝑥 = = = 13.51 𝐺𝐻𝑧
𝑇𝑚𝑎𝑥 74

5. Diseñar F, usando el estilo DCVSL DINÁMICO. Use el DT (*) dado.

Layout

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 Simulación

6. D

7. En los circuitos mostrados las dimensiones W/L se dan micras. Mediante su

curva de transferencia, determinar los parámetros y explicar su significado para
cada circuito dado: VIH, VIL, VT; VOH, VOL, VM

A B

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  Para el circuito “A”
o LAYOUT

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 Simulación

Frecuencia Máxima de Operación:

1 1
𝐹𝑚𝑎𝑥 = = = 83.3𝐺𝐻𝑧
𝑇𝑟𝑚𝑎𝑥 12
Curva de Transferencia:

Parámetros:
 VIH
 = 1.31  VT = 0.44
 VOH = 1.52  VOL = 0.36
 VIL = 0.58  VM = 0.925

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  Para el circuito “B”
o LAYOUT

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 Simulación

Frecuencia Máxima de Operación:

1 1
𝐹𝑚𝑎𝑥 = = = 66.666𝐺𝐻𝑧
𝑇𝑟𝑚𝑎𝑥 17
Curva de Transferencia:

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 Parámetros:
 VIH = 0.33
 VOH = 1.52
 VIL = 1.082
 VT = 0.45 (NMOS) / -2.05(PMOS)
 VOL = 1.26
 VM = 0.905
4. X
5. En el circuito de la figura y la tabla se define una lógica ternaria (tres niveles de
voltaje): GND, Vdd/2,Vdd.d

LAYOUT

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 Simulación

Frecuencia Máxima de Operación:

1 1
𝐹𝑚𝑎𝑥 = = = 38.46𝐺𝐻𝑧
𝑇𝑟𝑚𝑎𝑥 26

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