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EXAMEN 2P
vasanza 1
Respuesta:
vasanza 2
Respuesta:
Respuesta:
vasanza 3
Problema #7: (5%)
En los siguientes diagramas de bloques funcionales, se muestra la escritura y lectura de datos usando el protocolo
de comunicación I2C (Inter-Integrated Circuit). Colocar los nombres que describen cada bloque:
Respuesta:
Respuesta:
vasanza 4
Problema #9: (20%)
Realizar el diagrama de circuito de hardware de un módulo de servocontrol, que cumpla con las siguientes
especificaciones:
1) El procesador central es EP1C12Q240, una serie de chips FPGA Cyclone producidos por Altera Company.
Principalmente completa la recepción de la entrada digital y la corrección de errores del módulo SDC del
módulo de detección de posición, recibe las instrucciones de control de posición y velocidad de la
computadora host, realiza la iteración de interpolación, completa el control PID de posición y velocidad,
cambia el control de entrada y salida, y se comunica con la computadora host.
2) Módulo SDC, que utiliza el convertidor digital de doble canal selsyn / resolutor M2S44RDC / SDC para
completar la extracción de posición y la conversión digital.
3) Módulo de comunicación de bus SPI, que utiliza un módulo de bus SPI personalizado dentro del FPGA
para comunicarse con la computadora host, para completar la interacción de información con la
computadora host.
4) SRAM: se adopta el chip SRAM asíncrono de alta velocidad ISSI IS61LV25616AL con capacidad de
256K * 16Bit. La señal de Word Enabler es independiente y puede operar en cada byte.
5) SDRAM: se adopta K4S32323232F de la compañía SAMSUNG, y su capacidad es de 2M * 32Bit.
6) FLASH: se adopta el Am29LV160D de AMD con una capacidad de 1M * 16Bit.
7) Módulo de control del bus: el controlador emite la señal del bus de datos. El chip de control de bus
SN74LVCC3245 se utiliza para el control de bus, que tiene las funciones de control de dirección,
aislamiento de señal y amplificación.
8) Interfaz AS: el dispositivo EPCS se programa directamente a través de la interfaz AS.
9) Interfaz JTAG: puede descargar la configuración a FPGA, programa de depuración, programa para Flash y
programa para dispositivo EPCS.
Referencia:
Lin, Y. (2019, March). Design of servo control system based on Nios soft core CPU. In IOP Conference Series:
Earth and Environmental Science (Vol. 242, No. 3, p. 032004). IOP Publishing.
Respuesta:
vasanza 5
Problema #10: (20%)
Dado la siguiente implementación de un sistema de procesador de cuatro núcleos en el SOPC Builder, realizar el
diseño del sistema de procesador de cuatro núcleos:
Referencia:
Wang, X. (2011, October). Multi-core system education through a hands-on project on fpgas. In 2011 Frontiers in
Education Conference (FIE) (pp. F2G-1). IEEE.
Respuesta:
vasanza 6
Problema #11: (10%)
De acuerdo con el siguiente código de un contador con su respectivo banco de prueba, dibuje el diagrama de
tiempo con los respectivos valores de señales desde su inicio hasta su fin:
vasanza 7