Examen Session de Rattrapage

« Architectures Avancées Sur SoC »

Enseignant  : M Dhafer Mezghani Durée  : 1H30
Documents  : Non autorisés Niveau : LAI3
Calculatrice : Non autorisée
SmartPhone : Non autorisé
Code Souche
Nom et prénom :………………………………………………………………
Nbre de pages : 6 CIN : ……………………….………………………………
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Code feuille d’examen

/20 N.B. : le nombre de lignes de réponse

n’est pas toujours significatif.
Exercices (5 points) :
1. Expliquer brièvement les instructions suivantes 2
 ADD $1,$2,$3
 ADDI $1,$2,10
 SLL $1,$2,10
 LW $1, 40($3)
….……………………………………………………………………………………………………………………………………………………………….
……………………………………………………………………………………………………………………………………………………………….
…………………………………………………………………………………………………………………………………………………………….….
……………………………………………………………………………………………………………………………………………………………….
……………………………………………………………………………………………………………………………………………………………
Soit le contenu initial de chaque registre et la mémoire de
données

Donner l’état de chaque registre affecté ou les cases mémoires

affectées après l’exécution de chaque instruction séparée
 LH $t1, ($t0)
……………………………………………………………………………………………………….……………
 LB $t1, ($t2)
……………………………………………………………………………………………………….……………

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 2. Donner le format d’instruction de chaque instruction sous forme 1.5
d’ensemble de champs. présenter les valeurs en décimale dans
chaque champ du format. sachant que pour :
format R : code opératoire est 0 et les fonctions sont 32 pour
ADD et 34 pour SUB
format I : code opératoire de lw est 35 et celui de beq est 4

 add $2,$1,$3 :

 Sub $5,$8,$1 ;

 LW $1,200($2) ;

 beq $6,$8,200 ;

Problème (13 points)

1. Nous rappelons le chemin de données monocycle MIPS (implémentant les instructions de

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 type R, addi, lw, sw et beq)

Etant donnée les latences d’exécution suivantes, donner le CPI et la durée du cycle de
l’horloge :
Memory: 200ps | Banc de registres (READ/Write): 50ps | ALU et Adders: 100ps | Portes
logiques et multiplexeurs : 1ps | tout le reste est négligeable.
CPI = …………………………………………………………………
P = …………………………………………………………………….

Nous voulons implémenter de nouvelles instructions MIPS. Pour ceci, nous nous proposons 1
d’apporter des modifications au chemin de donnée et aux signaux de contrôle, en suivant les
consignes suivantes :
- Il est recommandé de minimiser le nombre de matériel à ajouter. 1
- En ajoutant une nouvelle instruction, il ne faut pas altérer le fonctionnement des
instructions de base.
- Eviter d’ajouter des ALU, des additionneurs, des registres ou des mémoires au chemin 1
de données.
- Il est possible d’ajouter des multiplexeurs et des portes logiques.

Pour chacune des nouvelles instructions mentionnées, donner le RTL, la modification du

chemin de données, les valeurs des signaux de contrôle et la valeur du cycle d’horloge. Les
instructions sont indépendantes et il sera tenu compte de l’optimalité de la solution.
2. instruction :
getpc $rt ; Cette instruction met dans $rt la valeur de PC de cette instruction.
RTL : ……………………………………………………………………………………………………………………………………….
Chemin des données modifié :

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 1

Points de contôle :

Nouvelle durée du cycle de l’horloge :………………………………………

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 Instruction
add3 $rd, $rs, $rt, $rx ; Add à 3 opérandes, nouveau format d’instruction (opcode(6), rs(5),
rt(5), rd(5), rx(5), (6 bits sont non utilisés)). Cette instruction met dans le registre $rd la
somme des contenus des registre $rs, $rt et $rx
RTL : …………………………………………………………………………………………………………………………………….

Chemin des données modifié :

Points de contôle :

Nouvelle durée du cycle de l’horloge :………………………………………

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 Instruction :
swinc Rt, Imm16(Rs) ; Store Word and Increment, cette instruction sauvegarde $rt dans la
mémoire d’adresse $rs plus l’extension de Imm16 ET le contenue de $rs pointera sur le mot
suivant.
RTL : …………………………………………………………………………………………………………………………………….

Chemin des données modifié :

Points de contôle :

Nouvelle durée du cycle de l’horloge :………………………………………

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