AMPLIFICADOR MULTIETAPA

Douglas Eduardo Pineda Caldern: 1160341 Andrea Milena Gmez Chacn: 1160287 Sergio Andrs Yez Madrid: 1160355

Abstract En el siguiente laboratorio se disear un circuito amplificador de potencia, el cual deber cumplir con una ganancia de voltaje de 250, para esto se utilizarn unos parmetros de diseo con la finalidad de que el transistor opere en su regin lineal.

3. Resistencia de entrada mayor o igual 50K. 4. Resistencia de salida menor o igual a 100. 5. Punto terminal de -3dB de baja frecuencia menor o igual a 40Hz (fL40Hz). 6. Punto terminal de -3dB de alta frecuencia mayor o igual 40Khz (fh40KHz). 7. Respuesta en la banda de paso mximamente plana. 8. El amplificador debe estar compensado con respecto a variaciones de temperatura. 9. Fuentes de alimentacin de 12v. 10. Todas las mediciones se realizaran con una carga de 100 conectada al amplificador previamente diseado DISEO Se decidi por un amplificador de 5 etapas, en donde se van a distribuir en 3 colector comn y 2 emisor comn, estos ltimos tendrn ganancias de Av=25 y Av=10. El diseo del amplificador se describe a continuacin. DISEO DE COLECTOR COMUN

I. INTRODUCTION Con este informe se busca aplicar los conocimientos adquiridos en el transcurso de la carrera, con el fin de disear y evaluar un amplificador multi-etapa discreto, en cual deber cumplir ciertos parmetros de voltaje DC, ganancia, Rout, Rin, RL, entre otras.

II. OBJETIVOS Desarrollar en el estudiante una metodologa para el diseo de amplificadores multi-etapa discretos. Comprobar de manera analtica los parmetros principales de operacin del amplificador en DC y AC y confrontarlos conjuntamente con los obtenidos en el laboratorio y con los datos de herramientas CAD. Cumplir con los requerimientos importantes del diseo como ganancia de voltaje Av. Zo, Zi, y la excursin mxima de la seal de salida. Profundizar en el uso de la herramienta ORCAD PSPICE para la simulacin del circuito y la posterior comparacin de los datos tericos y experimentales. . III. PROCEDIMIENTO Los parmetros necesarios para el diseo del amplificador de potencia son los siguientes: 1. Ganancia de voltaje mayor o igual a 250 2%. 2. Manejo de seal a la salida: 12 V pico a pico.

Se deben conocer un mnimo de parmetros para el diseo de estas etapas, los cuales son RL, Vcc, B. Igualamos,

Para obtener el valor de Re. La corriente del transistor para excursin mxima se toma de la siguiente ecuacin,

Donde, 1
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 Con estos valores hallamos,

Teniendo en cuenta los mtodos para los diseos de EC y CC, procederemos a disear desde la ultima etapa hasta la primera, pues la resistencias de entrada y salida afectan por el efecto de carga.
RESISTENCIAS POR ETAPA ETAPA 1 ETAPA 2 ETAPA 3 ETAPA 4 ETAPA 5 330 k 270 k 150 k 12 k 1.2 k 560 k 68 k 10 k 33 k 3.3 k 22 k 150 390 820 100 NO 2.2 k NO NO NO NO 10 k 8.2 k NO NO
Tabla 1. Valores comerciales de las resistencias por etapas.

R1 R2 Re Rec Rc

ANALISIS TEORICO DISEO DE EMISOR COMUN Se deben conocer un mnimo de parmetros para el diseo de estas etapas, los cuales son Av, RL, Vcc, B. Igualamos, Se realizo un anlisis terico con estas resistencias comerciales, para tener un conocimiento base de los datos, y as poder con la simulacin y experimentacin del multi-etapa. Estos datos son obtenidos por medio de las ecuaciones ya estudiadas en cursos anteriores a este. . .
ETAPA 1 Ic 622.07 uA Vce 10.31 V Rout 41.51 Rin 198.34 k Av 0.99 ANALISIS TEORICO ETAPA 2 ETAPA 3 ETAPA 4 ETAPA 5 1.59 mA 1.82 mA 19.46 mA 150.12 mA 4.36 V 8.34 V 8.03 V 8.98 V 10 k 8.2 k 1.32 0.17 21.86 k 8.4 k 8354.65 783.1 -27,33 -10,18 0.99 0.99

Para obtener el valor de Para obtener el valor de

La corriente del transistor para excursin mxima se toma de la siguiente ecuacin,

Tabla 2. Anlisis terico en DC y AC.

SIMULACION Donde, BIAS POINT Con estos valores hallamos, Presenta los valores obtenidos en el software ORCAD 10.3, donde se simulo con los datos de las resistencias comerciales de diseo.

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TEORICO VALOR Ic1 Ic2 Ic3 Ic4 Ic5 Vce1 Vce2 Vce3 Vce4 Vce5 622,078 uA 1,59 mA 1,82 mA 19,46 mA 150,12 mA 10,31 v 4,36 v 8,34 v 8,03 v 9v

S IMULADO VALOR 607 uA 1,52 mA 1,82 mA 19,1 mA 144 mA 10,5 v 5,24 v 8,38 v 8,24 v 9,29 v ERROR % 2,42% 4,40% 0% 1,84% 4,07% 1,84% 20,18% 0,48% 2,60% 3,20%

EXPERIMENTAL VALOR 610 uA 1,55mA 1,80 mA 19,33 mA 148 mA 10,2 v 4,5 v 8,35 v 8.1 v 9,15 v ERROR % 1,94% 2,50% 1,10% 0,66% 1,41% 1,06% 3,20% 0,12% 0,87% 1,60%

ANALISIS EN AC

IV. CONCLUSIONES Se debi colocar dos etapas emisor comn, pues para un multietapa no se permite que las etapas tengan una ganancia mayor a 30. Se utilizaron dos colector comn en la salida para poder acoplar sin problemas la salida tan pequea que se pide en los parmetros, otra solucin a este problema seria disear cuatro emisor comn pero seria ineficiente pues tendra una etapa mas el amplificador. Al calcular los valores que deben tener los capacitores para garantizar un buen manejo de la frecuencia, concluimos que los capacitores que ms afectan son los de desvo, as que se dejaron los otros igual y se coloco uno bastante grande en la Re de la 2 etapa. Se debi utilizar un capacitor tipo lenteja 101 (100 pF) en la 2 etapa del amplificador, para eliminar el ruido que provocaba esta debido a que era la que mas ganancia tenia, esta lenteja provoco un descenso en la ganancia lo que nos llevo a modificar la resistencia desviada y la resistencia que no esta desviada de tal manera que solo se afectara al circuito en baja frecuencia para que en dc siguiera cumpliendo con nuestros parmetros de excursin.

Figura 1. Onda de voltaje de salida.

Figura 2. Funcin de frecuencia.

V. BIBLIOGRAFIA SEDRA, Adel. Circuitos Microelectrnicos, Quinta Edicin. Mxico D.F. Editorial Mc Graw-Hill, 2006. HORENSTEIN, Mark. Microelectrnica: Dispositivos. Mxico D.F. Editorial Prentice Hall Interamericana S.A., 1997. Circuitos y

EXPERIMENTAL

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NEAMEN, Donald A. Anlisis y Diseo de Circuitos Electrnicos, Tomo I. Mxico D.F. Mc Graw-Hill, 1999. A. GULLO, J. Diseo Electrnico: Circuitos y Sistemas. Argentina. Editorial Addison Wesley Iberoamrica, S.A, 1992. BOYLESTAD, Robert L. Electrnica: Teora de Circuitos. Mxico D.F. Editorial Prentice Hall Hispanoamericana, S.A. 1997.

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