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Kultur Dokumente
=
B
BE BB
B
R
V V
I
I
c
= |I
B
= 8,125 mA
Q
Q
Q
Saturacin
Corte
I
C
I
B
R
e
g
i
n
a
c
t
i
v
a
Lnea de carga y punto de funcionamiento
Presentacin por Jos Quiles Hoyo
Lnea de carga y punto de funcionamiento
V
BE
0,7 V
V
CE
(V) I
c
(mA)
0 12,00 5,550 6,450
1000 O 12 0,00
100 kO
| 150
12 V
5 V
43,000 I
B
43,00 A 30,1 P
EB
30,10 W
6,450 I
c
6,45 mA 35,7975 P
CE
35,80 mW
6,493 I
E
6,49 mA P
T
35,83 mW
5,550 V
CE
5,55 V
4,850 V
CB
4,85 V
V
CC
V
B
B
R
B
R
C
0
2
4
6
8
10
12
14
0 2 4 6 8 10 12 14
V
cc
(V)
I
c
(
m
A
)
43,00 A 6,45 mA
6,49 mA
5,55 V
E
C
B
Presentacin por Jos Quiles Hoyo
V
CE
= -I
C
R
C
+ V
CC
I
C
V
CE
Q
O
V
CE
I
C
R
C
V
CC
C
CE CC
C
R
V V
I
=
C
CC
R
V
R
C
R
B
V
BE
V
CC
V
BB
V
CE
I
B1
I
B2
I
B4
I
B3
Lnea de carga y punto de funcionamiento
Presentacin por Jos Quiles Hoyo
I
C
V
CE
I
B1
I
B2
I
B4
I
B3
R
C
R
B
V
BE
V
CC
V
BB
V
CE
I
C
I
B
V
CC
C
CC
R
V
Punto de funcionamiento: I
B
Presentacin por Jos Quiles Hoyo
I
C
V
CE
I
B1
I
B2
I
B4
I
B3
R
C
R
B
V
BE
V
CC
V
BB
V
CE
I
C
I
B
V
CC
1 C
CC
R
V
2 C
CC
R
V
3 C
CC
R
V
Punto de funcionamiento: R
C
Presentacin por Jos Quiles Hoyo
I
C
V
CE
I
B1
I
B2
I
B4
I
B3
R
C
R
B
V
BE
V
CC
V
BB
V
CE
I
C
I
B
V
CC3
C
CC
R
V
3
C
CC
R
V
2
C
CC
R
V
1
V
CC2
V
CC1
Punto de funcionamiento: V
CC
Presentacin por Jos Quiles Hoyo
B
E
B
C
I
C
V
CE
V
CC
Si V
BB
|, I
B
= |, I
E
~I
C
= V
CC
/R
C
zona de saturacin
cortocircuito CE V
CE
= 0
Si V
BB
= 0 o < 0,7 V, I
B
= 0,
I
E
~I
C
~ 0, V
CE
= V
CC
Zona de corte
circuito abierto V
CE
= V
CC
El transistor como conmutador
Presentacin por Jos Quiles Hoyo
V
BB
(V) V
CE
(V) I
c
(mA) I
B
(A)
0,7 10 0 0
0,8 9,375 0,625 6,25
0,9 8,75 1,25 12,5
1 8,125 1,875 18,75
1,2 6,875 3,125 31,25
1,4 5,625 4,375 43,75
1,6 4,375 5,625 56,25
1,8 3,125 6,875 68,75
2 1,875 8,125 81,25
2,2 0,625 9,375 93,75
2,3 0 10 100
R
B
R
C
+V
CC
V
salida
V
entrada
V
entrada
V
salida
A Y
Y = not A
INVERSOR
Circuito inversor simple
Presentacin por Jos Quiles Hoyo
I
E
I
B
P
Emisor
P
Colector
N
Base
I
C
R
L
A
D
V
EB
V
E
B
C
g
m
: transconductancia
AV
AD
= R
L
AI
C
A(-I
C
) = g
m
AV
EB
m L
EB
AD
g R
V
V
=
A
A
Transistor de unin: amplificador
Presentacin por Jos Quiles Hoyo
Transistor de efecto campo de unin
(JFET)
Transistor de efecto campo metal-
xido-semiconductor (MOSFET)
Transistores de efecto campo
Presentacin por Jos Quiles Hoyo
n
Drenador D
Fuente S
Puerta G
p p
Regin de agotamiento
Contactos hmicos
Transistores de efecto de campo de unin
(JFET)
Presentacin por Jos Quiles Hoyo
Canal n
Canal p
Fuente
Drenador
Puerta
+V
DD
D
S
G
I
G
V
G
-V
DD
D
S
G
I
G
V
G
Transistor de efecto campo de unin (JFET)
Presentacin por Jos Quiles Hoyo
n
p
p
S
G
D
I
D
I
D
V
DD
I
D
V
DS
I
DSS
V
P
Voltaje de estrechamiento
Al aumentar la tensin entre
Drenador y Fuente V
DS
, la
intensidad I
D
aumenta, al tiempo
que se estrecha el pasillo debido
al incremento de la de las uniones
p-n y la ampliacin de la regin de
agotamiento.
El pasillo se cierra para V
DS
= V
P
;
tensin para la que I
D
deja de
aumentar.
T
r
a
n
s
i
s
t
o
r
e
s
d
e
e
f
e
c
t
o
d
e
c
a
m
p
o
d
e
u
n
i
n
Presentacin por Jos Quiles Hoyo
V
DD V
DD
n n
p
p
p
p
S
S
G G
D
D
I
D
I
D I
D I
D
V
GS
=0
Manteniendo nula la tensin entre la fuente y G, V
GS
, al aumentar la
tensin entre Drenador y Fuente V
DS
, la intensidad I
D
aumenta, al
tiempo que se estrecha el pasillo debido al incremento de la de las
uniones p-n y la ampliacin de la regin de agotamiento .
Transistores de efecto de campo de unin
(JFET)
Presentacin por Jos Quiles Hoyo
V
DD
n
p
p
S
G
D
I
D
I
D
V
DS
I
DSS
I
D
Regin de comportamiento hmico
Estrechamiento del canal,
aumento de la resistencia
Para
V
GS
=0
V
P
Voltaje de estrechamiento, V
P
Al aumentar la tensin entre
Drenador y Fuente V
DS
, la
intensidad I
D
aumenta, al tiempo
que se estrecha el pasillo debido
al incremento de la de las uniones
p-n y la ampliacin de la regin de
agotamiento
El pasillo se cierra para V
DS
= V
P
Corriente de saturacin, I
DSat
Estrechamiento del canal
Presentacin por Jos Quiles Hoyo
V
GS
< 0
I
D
V
DD
n
S
G
D
I
D
I
D
p
p
V
DS
I
D
V
GS
= -1 V
V
GS
= -3 V
V
GS
= 0 V
V
P
(para V
GS
=0)
2
1
|
|
.
|
\
|
=
P
GS
DSS Dsat
V
V
I I
I
DSat3
V
GS
= -V
P
Con valores negativos de V
GS
el
pasillo se cierra antes, siendo la
corriente de saturacin menor
V
P
I
DSS
I
DSat2
I
DSat1
Estrechamiento del canal
Presentacin por Jos Quiles Hoyo
V
DS
(V)
I
D
(mA)
V
GS
= -1 V
V
GS
= -2 V
V
GS
= 0 V
2
5
1 8 , 7
|
.
|
\
|
=
GS
Dsat
V
I
I
DSS
V
GS
= -V
P
S
G
D
5 10 15
1
5
V
P
=5 V
-2 -4 0
V
GS
(V)
-5 -3 -1
V
P
V
GS
= -3 V
Intensidad de saturacin I
DS
=f(V
GS
)
Presentacin por Jos Quiles Hoyo
D
G sustrato
n
S
D
G sustrato
p
S
D
G sustrato
n
S
D
G sustrato
p
S
D S G
n
p
n
D S G
n
p
n
Metal
xido
Semiconductor
Metal
de enriquecimiento de agotamiento
pMOS-FET
de enriquecimiento
nMOS-FET
de enriquecimiento
pMOS-FET
de agotamiento
nMOS-FET
de agotamiento
Formado por una placa de metal y un semiconductor, separados por una zona de xido del semiconductor -
por ejemplo SiO
2
- de unos 100 nm de espesor. Posee cuatro electrodos:
Compuerta, gate en ingls, simbolizado con G; que se conecta a la placa metlica.
Fuente (Source) y drenador (Drain), ambos simtricos, que se internan en el sustrato.
Sustrato (Body), generalmente conectado elctricamente con la fuente.
T
r
a
n
s
i
s
t
o
r
d
e
e
f
e
c
t
o
c
a
m
p
o
m
e
t
a
l
-
x
i
d
o
-
s
e
m
i
c
o
n
d
u
c
t
o
r
(
M
O
S
F
E
T
)
Presentacin por Jos Quiles Hoyo
p
D
G
n n
SiO
2
S
Contactos metlicos
D
G sustrato
p
S
MOSFET de enriquecimiento n
Presentacin por Jos Quiles Hoyo
p
S
D
G
V
DS
+++++++++++++
n n
e
-
atrados por la puerta +
V
GS
>V
T
I
D
Regin de agotamiento
D
G sustrato
p
S
- - - - - - - - - - - - - - - - -
Formacin del canal en el MOSFET de
enriquecimiento n
Presentacin por Jos Quiles Hoyo
D
G sustrato
p
S
p
S
D
G
V
DS
+++++++++++++
n n
V
GS
>V
T
I
D
- - - - - - - - - - - - - - - - -
Al aumentar V
DS
, se estrecha el canal, alcanzndose la I de
saturacin, I
DS
Formacin del canal en el MOSFET de
enriquecimiento n
Presentacin por Jos Quiles Hoyo
C
a
r
a
c
t
e
r
s
t
i
c
a
M
O
S
F
E
T
d
e
e
n
r
i
q
u
e
c
i
m
i
e
n
t
o
d
e
c
a
n
a
l
n
V
DS
I
D
(mA)
V
GS
= 4 V
V
GS
= 6 V
V
GS
= 5 V
V
GS
= V
T
En ausencia de canal para V
GS
= 0, no hay corriente I
D
. Es necesario un valor
mnimo de voltaje umbral V
T
positivo de V
GS
para que se forme el canal.
Aumentando V
GS
aumenta el valor de la corriente de saturacin
V
GS
= 7 V
2
) (
T GS Sat D
V V K I =
5 3 7
I
D
(mA)
V
GS
(V)
1 2 4 6 8
V
T
n
+
p
G
S
D
+ V
D
- - - - - - - -
- - - - - - - - -
+ V
G
+ + + + + +
n
+
p
G
S
D
+ V
DS
=V
Dsat
n
+
n
+
- - - - - - - - -
- - - - - - - - -
+ + + + +
n
+
n
+
p
G
S
D
+ V
DS
+ V
G
Presentacin por Jos Quiles Hoyo
p
S
D
G
n n
n
D
G sustrato
p
S
MOSFET de agotamiento n
Presentacin por Jos Quiles Hoyo
p
V
DS
n n
V
GS
= 0
I
D
Con V
GS
=0 ya existe canal y los e
-
del canal son
atrados por D
S
D
G
D
G sustrato
p
S
- - - - - - - - - - - - - - - - -
n
MOSFET de agotamiento n
Presentacin por Jos Quiles Hoyo
D
G sustrato
p
S
p
V
DS
V
GS
< 0
I
D
n
S
D
G -
- - - - - - - - - - - - - - -
+ + + + + + + + + + + + + + +
n n
- - - - - - - - - - - -
+ + + + + + + + + +
Con V
GS
<0, los e
-
del canal son repelidos hacia la zona p,
recombinndose con huecos. La corriente de saturacin
disminuye.
MOSFET de agotamiento n
Presentacin por Jos Quiles Hoyo
C
a
r
a
c
t
e
r
s
t
i
c
a
M
O
S
F
E
T
d
e
a
g
o
t
a
m
i
e
n
t
o
d
e
c
a
n
a
l
n
V
DS
(V)
I
D
(mA)
V
GS
= -3 V
V
GS
= -2 V
V
GS
= -1 V
V
GS
= 0 V
V
GS
= 1 V
5 10 15
2
1
|
|
.
|
\
|
=
p
GS
DSS D
V
V
I I
2
4
1 8 |
.
|
\
|
=
GS
D
V
I
5
10
D
G sustrato
p
S
n
+
n
+
p
G
S
D
+ V
DS
n
V
GS
(V)
-3 -2 -1 0 1
V
P
5
10
I
DSS
I
D
(mA)
-4
- V
G
- - - - - - -
n
+
p
G
S
D
+ V
DS
=V
Dsat
n
+
- - - - - - - - -
- - - - - - - - -
Presentacin por Jos Quiles Hoyo
Aplicaciones: circuitos lgicos
puertas AND y OR, lgica de diodos
1N914
1N914
A
B
R
V
s
10 V
Puerta AND con diodos
V
s
R
Puerta OR con diodos
Presentacin por Jos Quiles Hoyo
1950: Abandono de las vlvulas de vaco y sustitucin
por transistores individuales
1960: Circuitos integrados en sustrato de silicio
1980: Transistores de efecto campo
1993: Tecnologa CMOS
Del vaco al CMOS
Presentacin por Jos Quiles Hoyo
Inversor (NOT)
Aplicaciones: circuitos lgicos
tecnologa CMOS
Presentacin por Jos Quiles Hoyo
G
D
S
FILA
BIT
Se almacena un 1 en la celda cargando el
condensador mediante una V
G
en fila y V
D
en bit
La lectura se hace aplicando V
G
en fila y midiendo la
corriente en la lnea bit
La lectura es un proceso destructivo. Hay que
restaurar el valor ledo
SRAM
DRAM
Aplicaciones: memorias RAM
Presentacin por Jos Quiles Hoyo
EPROM
MOSFET ROM
Aplicaciones: memorias ROM
Presentacin por Jos Quiles Hoyo
CCD
CMOS sensor
Aplicaciones: CCD
Presentacin por Jos Quiles Hoyo
Estructura DRAM con celda
LCD i LED
RGB
Aplicaciones: TFT