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Vanessa VARGAS
Docente - Investigadora
Departamento de Eléctrica y Electrónica
vcvargas@espe.edu.ec
AGENDA
Introducción
SISTEMAS COMPUTACIONALES
BAJO
GRAN
CONSUMO
FIABILIDAD
Redundancia DE ENERGÍA Tecnologías
emergentes
ALTO PRECIO
DESEMPEÑO BAJO
?
Componentes
Paralelismo estándar
3
INTRODUCCIÓN CONTEXTO
SISTEMAS COMPUTACIONALES
DESEMPEÑO
PROCESADORES
MULTI/MANY-CORE
Gran capacidad
de tratamiento
SISTEMAS Redundancia intrínsica
EMBEBIDOS
Paralelismo
Basado en el
1er Top500
many-core
Sunway Sistemas High Un sólo
CRÍTICAS
TAREAS
SW26010 Performance
260 cores core es
Computing (HPC) Sistemas embebidos
y críticos utilizado
SISTEMAS COMPUTACIONALES
COSTO
MÍNIMO
USO DE
MICROCONTROLA-
DORES EN SISTEMAS
EMBEBIDOS
EFICIENCIA
ENERGÉTICA
5
AGENDA
Introducción
Características de Microcontroladores
NIVELES DE DESCRIPCIÓN
4/3/19 7
PROBLEMATICA PROCESADOR
ARQUITECTURA BÁSICA
MEMORIA
contiene el
programa
Memoria (instrucciones
) y datos.
a cargo de la
Una unidad secuenciación
ENTRADA SALIDA de control de
operaciones.
Una unidad
de entrada /
salida.
Modelo de Von Newman (1945)
4/3/19 8
EVOLUCIÓN DE LOS
PROBLEMATICA PROCESADORES
MEMORY
CONTROL
ALU
UNIT INTER-CORE COMMUNICATIONS
CORE
I/ L3 SHARED CACHE MEMORY
O
L1 CACHE BUS INTERFACE
I/ HUB I/O
L2 CACHE
O I/O
MEMORY CONTROLLER
CONTROLLER
MEMORY CONTROLLER
EXTERNAL MEMORY HUB I/O
PROCESADOR MANY-CORE
EXTERNAL MEMORY COMPUTE CLUSTER
INTER-CORE COMMUNICATIONS
Paridad
CLUSTER CLUSTER I/ BUS INTERFACE DMA
O
I/ ECC,C
O
CLUSTER Entrelazamiento
CLUSTER L SHARED MEMORY D-NOC C-NOC
C U
L S
U T
S E
HUB I/O
T R
E
CLUSTER CLUSTER
R
LOCAL
MEMORY CONTROLLER MEM
10
ECC Error Correcting Code KALRAY MPPA-256 many-core procesor 2016
PROBLEMATICA EVALUACIÓN DEL DESEMPEÑO
FLOPS
4/3/19 11
PROBLEMATICA EVALUACIÓN DEL DESEMPEÑO
FLOPS
4/3/19
13
PROBLEMATICA EVALUACIÓN DEL DESEMPEÑO
60%/año
Gap ↗
de 50%/año
10%/año
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14
PROBLEMATICA
SECUENCIAL VS PARALELA
Start
Task n
Task 1 Task 2 Task n
End
End
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PREGUNTAS
4/3/19 17