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SchnellstartAnleitungfrXilinxISEundISim

(V.1.0)

NeuesVHDLProjektanlegen:
1) ISEProjectNavigatorstarten
2) FileNewProject
3) Projektnameeingeben,
Toplevelsourcetype:HDLauswhlen,
Next
4) ProjectSettings:
Family:XC9500XLCPLDs
Simulator:ISim(VHDL/Verilog)
PreferredLanguage:VHDL
VHDLSourceAnalysisStandard:VHDL93
NEXT
5) Finish

NeueVHDLDateianlegenunddemProjekthinzufgen:
1) ProjectNewSource
2) NewSourceWizard:
SourceType:VHDLModule
Filename:<Dateiname>(Bspw.:Top.vhd)
Addtoprojectmussaktiviertsein
NEXT
3) DefineModule:
Portnameneingeben,
Portrichtungenauswhlen,
BeiBussignalenmussentsprechenddasFeldBusaktiviertwerden,
BeiBussignalenmusseinEintraginMSBundLSBerfolgen(7und0(7downto0))
NEXT
4) Summary
Finish

Syntaxprfung(CPLDDesign):
1) nderungenimSourceCodespeichern
2) ImFensterHierarchy(links)diezuprfendeQuellcodedateimarkieren.
ZurPrfungallerQuellcodesdieTopLevelDateiauswhlen.
3) ImdarunterliegendenFenster:
ImplementDesignentfalten
SynthesizeXSTentfalten
CheckSyntax(Doppelklick)
4) ErgebnissederSyntaxprfungwerdenindemConsolenFensterausgegeben
GrafischeDarstellungderSyntheseergebnisse(CPLD):
1) ImFensterHierarchydieTopLevelDateimarkieren
2) ImdarunterliegendenFenster:
ImplementDesignentfalten
SynthesizeXSTentfalten
ViewRTLSchematic (technologieunabhngigesErgebnis)
oder:
ViewTechnologySchematic (technologiespez.Ergebnis)

Konfigurationsdateierzeugen:
1) ImFensterHierarchydieTopLevelDateimarkieren
2) ImdarunterliegendenFenster:
ImplementDesignentfalten
GenerateProgrammingFile


TestbencherzeugenunddemProjekthinzufgen:
1) ProjectNewSource
2) NewSourceWizard:
SourceType:VHDLTestBench
Filename:<Dateiname>(Bspw.:Top_TB)
Addtoprojectmussaktiviertsein
NEXT
3) AssociateSource:
EntityAuswhlen,frdieeineTestbencherzeugtwerdensoll
NEXT
4) Summary:
Finish
5) EigenenCodederTestbenchhinzufgen
6) Speichern

Simulatorstarten:
1) View:Simulation(linksberdemHierarchyFenster)
2) AuszufhrendeTestbenchmarkieren
3) ImdarunterliegendenFenster:
ISimSimulatorentfalten
SimulateBehavioralModel

SignalederSimulationhinzufgen:
1) ImFensterInstanceandProcessesdieQuelleinheitdeshinzuzufgendenSignals
auswhlen.(TestbenchoderEntwurfscode(UUT))
2) ImFensterObjectsdasSignalauswhlenundperDragAndDropindasSimulationsfenster
ziehen.

Simulationausfhren:
1) Restart (blauerLinkspfeilinderSymbolleisteODERSimulationRestart)
2) SimulationsdauerinderSymbolleisteeintragen(bspw.:500ns)
3) SimulationRun

BeinderungenimSourcecodeoderderTestbenchmussderRelaunchButtonzur
ReinitialisierungdesSimulatorsverwendetwerden.